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參數(shù)資料
| 型號： | EP1S30F780I6N |
| 廠商： | Altera |
| 文件頁數(shù)： | 847/864頁 |
| 文件大小： | 0K |
| 描述： | IC STRATIX FPGA 30K LE 780-FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 產(chǎn)品變化通告： | Package Height Change 03/March/2008 |
| 標準包裝： | 18 |
| 系列： | Stratix® |
| LAB/CLB數(shù)： | 3247 |
| 邏輯元件/單元數(shù)： | 32470 |
| RAM 位總計： | 3317184 |
| 輸入/輸出數(shù)： | 597 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 780-BBGA |
| 供應(yīng)商設(shè)備封裝： | 780-FBGA（29x29） |
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Altera Corporation
14–21
January 2005
Stratix Device Handbook, Volume 2
Designing with 1.5-V Devices
Board Layout
Laying out a printed circuit board (PCB) properly is extremely important
in high-frequency (
≥100 kHz) switching regulator designs. A poor PCB
layout results in increased EMI and ground bounce, which affects the
reliability of the voltage regulator by obscuring important voltage and
current feedback signals. Altera recommends using Gerber files
pre-
designed layout files
supplied by the regulator vendor for your board
layout.
If you cannot use the supplied layout files, contact the voltage regulator
vendor for help on re-designing the board to fit your design requirements
while maintaining the proper functionality.
Altera recommends that you use separate layers for signals, the ground
plane, and voltage supply planes. You can support separate layers by
using multi-layer PCBs, assuming you are using two signal layers.
EP1C12 maximum power-up current requirement
See Power Consumption section of the Cyclone FPGA Family
Data Sheet for other densities
IPUC(MAX) = 900 mA
Maximum output current required
Compare ICC with IPUC(MAX)
IOUT(MAX) = 900 mA
Voltage regulator selection
See Linear Technology LTC 1649 data sheet
See Intersil (Elantec) EL7562C data sheet
LTC1649 IOUT(MAX) =
EL7562C IOUT(MAX) =
15 A
2 A
LTC1649
Nominal efficiency (
η)
Nominal efficiency (
η) = > 90%
Line and load regulation
Line regulation + load regulation = (0.17 mV + 7 mV)/ 1.5 V
× 100%
Line and Load
Regulation = 0.478% < 5%
Minimum input voltage (VIN(MIN))
(VIN(MIN)) = VIN(1 –
ΔV
IN) = 3.3V(1 – 0.05)
(VIN(MIN)) = 3.135 V
Maximum input current
IIN, DC(MAX) = (VOUT
× IOUT(MAX))/(η× VIN(MIN))
IIN, DC(MAX) = 478 mA < 2 A
EL7562C
Nominal efficiency (
η)
Nominal efficiency (
η) = > 95%
Line and load regulation
Line regulation + load regulation = (0.17 mV + 7 mV)/ 1.5 V
× 100%
Line and Load
Regulation = 0.5% < 5%
Minimum input voltage (VIN(MIN))
(VIN(MIN)) = VIN(1 –
ΔVIN) = 3.3V(1 – 0.05)
(VIN(MIN)) = 3.135 V
Maximum input current
IIN, DC(MAX) = (VOUT
× I
OUT(MAX))/(
η× V
IN(MIN))
IIN, DC(MAX) = 453 mA < 2 A
Table 14–8. Voltage Regulator Selection Process for EP1C12F324C Design (Part 2 of 2)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 24LC02BT-I/MS | IC EEPROM 2KBIT 400KHZ 8MSOP |
| EP1S30F780C5N | IC STRATIX FPGA 30K LE 780-FBGA |
| 24AA02T-I/MS | IC EEPROM 2KBIT 400KHZ 8MSOP |
| EP2SGX60EF1152I4N | IC STRATIX II GX 60K 1152-FBGA |
| ASM36DTBS | CONN EDGECARD 72POS R/A .156 SLD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EP1S-3G1 | 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE |
| EP1S-3G1T | 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE |
| EP1S-3G1TT | 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE |
| EP1S-3G2 | 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE |
| EP1S-3G2T | 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE |
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