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參數(shù)資料
| 型號： | MC68SC302 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 67/218頁 |
| 文件大小： | 521K |
| 代理商： | MC68SC302 |
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Communications Processor (CP)
MOTOROLA
MC68SC302 USER’S MANUAL
4-21
The RISC can set the BSY interrupt when it has no place to write new data, or when it has
no place to open a new BD for new incoming data. When BSY is set, the RISC stops
receiving new data from the SCC. The user can read from the RAM the data received until
the busy condition occurred. The host should then give the INITIALIZE RX command to the
CR. This command initializes the PRAM receive section, clears the SCC Rx memory chunk
and forces the SCC to enter the hunt mode. The next HDLC frame will be written to the first
address in the Rx memory chunk.
The host holds a pointer to the first not handled buffer, RNH in SCCE. RNH is a pointer
which always points to the next BD to be handled by the CPU. Initially, after reset and before
SCC is enabled, the user must initialize RNH to the same value as RBASE, since the first
Rx BD will be located at the address pointed to by RBASE.
During interrupt request handling, the CPU updates RNH after reading an Rx data buffer. Its
new value is the address of the next BD to be handled by the CPU. It is computed by adding
the length of the previous data buffer to the previous RNH. When interrupted, the host
should check the E bit in this BD. If E=0, the host can read the buffer. After reading the
buffer, the host then checks the next BD. If E=0, it can read this buffer also, and so on. After
reading all the ready buffers, the host
should update the CPU first not handled parameter to
point to the next BD, and clear the RTH/TO bit in the SCC event register.
While reading the ready buffers, the host may update the CPU first not handled parameter
to point where it has not read yet. This will free a space for the RISC, and reduce the chance
of a BSY condition. (The CPU first not handled parameter should always be even.)
In the HDLC mode, there could be a case where a frame is received, and after that, flags/
idles or frames without address match are not received for a long time. If the number of bytes
in the chunk is less than RTH, and the RXF bit of the event register is masked, the host will
not be interrupted. To solve this problem a time-out mechanism is used: The RISC counts
the number of octets (8 serial clocks) received in a channel. If this number exceeds the time-
out parameter RTO and there is data in the RAM, it can generate an interrupt (TO) to the
host.
A BD always starts at an even address. If a buffer length is odd, the byte after the last buffer
byte is “garbage” and the next BD starts at the next even address. The host should consider
this when calculating the next BD address.
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