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參數(shù)資料
| 型號(hào)： | MC68SC302 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 73/218頁 |
| 文件大?。?/td> | 521K |
| 代理商： | MC68SC302 |
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Communications Processor (CP)
MOTOROLA
MC68SC302 USER’S MANUAL
4-27
be disabled if only a change to a parameter RAM value is made. See Table 4-3
for a
description of which parameter RAM values may be modified.
To save power, the SCCs may simply be disabled. Clearing the enable transmitter (ENT) bit
in the SCC mode register causes the SCC transmitter to consume the least possible power;
clearing the ENR bit causes a similar action for the SCC receiver.
4.5.10 HDLC Controller
Layer 2 of the seven-layer OSI model is the data link layer. One of the most common layer
2 protocols is HDLC. Many other common layer 2 protocols are heavily based on HDLC,
particularly its framing structure, namely: SDLC, SS#7, LAPB, and LAPD. The framing
structure of HDLC is shown in Figure 4-9.
Figure 4-9. Typical HDLC Frame
HDLC uses a zero insertion/deletion process (commonly known as bit-stuffing) to ensure
that the bit pattern of the delimiter flag does not occur in the fields between flags. The HDLC
frame is synchronous and therefore relies on the physical layer to provide a method of
clocking and synchronizing the transmitter and receiver.
Since the layer 2 frame can be transmitted over a point-to-point link, a broadcast network,
or packet and circuit-switched systems, an address field is needed to carry the frame's
destination address. The length of this field is commonly 0, 8, or 16 bits, depending on the
data link layer protocol. For instance, SDLC and LAPB use an 8-bit address. SS#7 has no
address field at all because it is always used in point-to-point signaling links. LAPD further
divides its 16-bit address into different fields to specify various access points within one
piece of equipment. It also defines a broadcast address. Some HDLC-type protocols also
allow for extended addressing beyond 16-bits.
The 8- or 16-bit control field provides a flow control number and defines the frame type
(control or data). The exact use and structure of this field depends upon the protocol using
the frame.
Data is transmitted in the data field, which can vary in length depending upon the protocol
using the frame. Layer 3 frames are carried in the data field.
Error control is implemented by appending a cyclic redundancy check (CRC) to the frame,
which is 16-bits long in most protocols, but may be 32-bits long in some.
When the MODE bit of an SCC mode register (SCM) selects HDLC mode, then that SCC
functions as an HDLC controller. The HDLC controller handles the basic functions of the
HDLC/SDLC protocol on either the D channel, a B channel, or from a multiplexed serial
interface (IDL or GCI (IOM-2)). When the HDLC controller is used to support the B or D
OPENING
FLAG
8 BITS
ADDRESS
CONTROL
INFORMATION
(OPTIONAL)
8N BITS
CRC
CLOSING
FLAG
8 BITS
16 BITS
8 BITS
16 BITS
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