參數(shù)資料
型號: MC68SC302
廠商: Motorola, Inc.
英文描述: 32-Bit Microprocessor(32位微處理器)
中文描述: 32位微處理器(32位微處理器)
文件頁數(shù): 84/218頁
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代理商: MC68SC302
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Communications Processor (CP)
4-38
MC68SC302 USER’S MANUAL
MOTOROLA
should be followed by an ENTER HUNT MODE command to the channel. In both error
cases, the reception process will not proceed until synchronization has once again been
achieved.
If the REVD bit in the transparent mode register is set, each data byte will be reversed in its
bit order before it is written to memory.
4.5.11.3 TRANSPARENT MEMORY MAP.
When configured to operate in transparent
mode, the SC302 overlays the structure illustrated in Table 4-5 onto the protocol specific
area of that SCC parameter RAM. Refer to Table 4-3 for the placement of the three SCC
parameter RAM and for the protocol specific parameter RAM values.
# Must be Initialized by the user (host) to zero.
The only Transparent-specific parameter RAM that must be initialized by the user is the
ZERO register. The general SCC parameter RAM must also still be initialized.
The transparent controller uses the same basic data structure as the other protocol
controllers. Receive and transmit errors are reported through receive and transmit BDs. The
status of the line is reflected in the SCC status register, and a maskable interrupt is
generated upon each status change.
4.5.11.4 TRANSPARENT COMMANDS.
The following commands are issued to the
command register.
STOP TRANSMIT Command
After a hardware or software reset and the enabling of the channel using the SCC mode
register, the channel is in the transmit enable mode and starts polling the first BD in the
table approximately every 16 transmit clocks.
The STOP TRANSMIT command aborts transmission. If this command is received by the
transparent controller during a buffer transmission, transmission of that buffer is aborted
after the FIFO contents (up to four words) are transmitted. The TBD# is not advanced.
Ones are continuously transmitted until transmission is re-enabled by issuing the RE-
START TRANSMIT command.
Table 4-5. Transparent-Specific Parameter RAM
ADDRESS
NAME
WIDTH
DESCRIPTION
SCC BASE + 24
SCC BASE + 26
SCC BASE + 28
SCC BASE + 2A
SCC BASE + 2C
SCC BASE + 2E
SCC BASE + 30 #
SCC BASE + 32
SCC BASE + 34
SCC BASE + 36
SCC BASE + 38
RES
RES
RES
RES
RES
RES
ZERO
RES
RES
RES
RES
WORD
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