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參數(shù)資料
| 型號： | MC68SC302 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 93/218頁 |
| 文件大?。?/td> | 521K |
| 代理商： | MC68SC302 |
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Communications Processor (CP)
MOTOROLA
MC68SC302 USER’S MANUAL
4-47
4.6 SERIAL COMMUNICATION PORT (SCP)
The SCP is a full-duplex, synchronous, character-oriented channel that provides a three-
wire interface (receive, transmit, and clock). The SCP consists of independent transmitter
and receiver sections and a common clock generator. The transmitter and receiver sections
use the same clock, which is derived from the main clock by a separate on-chip baud rate
generator. Since the SC302 is an SCP master for this serial channel, it generates both the
enable and the clock signals.
The SCP allows the SC302 to exchange status and control information with a variety of
serial devices, using a subset of the Motorola Serial Peripheral Interface (SPI). The SCP is
compatible with SPI slave devices. These devices include industry-standard CODECs as
well as other microcontrollers and peripherals.
The SCP also allows the SC302 to load data from a serial EEPROM to its internal registers
or RAM. Three common types of serial EEPROMs are supported by the SCP.
The SCP enable signals, which can be implemented using the general-purpose I/O pins
(SCPENx), are used to enable one of several potential SCP slave devices. An additional
special enable signal (E2EN) is used to connect the serial EEPROM to the SCP. The clock
signal (SPCLK) shifts the received data (SPRXD) in and shifts the transmitted data (SPTXD)
out. The clock is gated: it operates only while data is being transferred and is idle otherwise.
Two successive byte transmissions over the SCP cannot occur immediately back-to-back.
A minimum delay of two to eight bit times is imposed by the SCP, depending on the SCP
clock rate (communication processor priorities and software handling of interrupts may
contribute extra delays). Higher SCP clock rates give higher minimum delay.
The SCP can be configured to operate in a local loopback mode, which is useful for local
diagnostic functions.
Note that the least significant bit of the SCP is labeled as data bit 0 on the serial line,
whereas other devices, such as the MC145554 CODEC, may label the most significant bit
as data bit 0. The SC302 SCP bit 7 (most significant bit) is shifted out first.
The SCP key features are as follows:
Three-Wire Interface (SPTXD, SPRXD, and SPCLK)
Full-Duplex Operation
Programmable Clock Generator
Large number of Device Enable signals (implemented as Parallel I/O)
Local Loopback Capability for Testing
4.6.1 SCP Programming Model
The SCP mode register consists of the upper nine bits of SPMODE. The SCP mode register,
an internal read-write register that controls both the SCP operation mode and clock source,
is initialized to ENabled with divide ratio of 4*11=44 (decimal) to enable the SC302 to access
the serial EEPROM after reset.
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PDF描述 |
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