- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377971 > ML53612 (OKI SEMICONDUCTOR CO., LTD.) 64-Channel Full Duplex H.100/H.110 CT Bus System Interface and Time-Slot Interchange PDF資料下載
參數(shù)資料
| 型號： | ML53612 |
| 廠商： | OKI SEMICONDUCTOR CO., LTD. |
| 英文描述： | 64-Channel Full Duplex H.100/H.110 CT Bus System Interface and Time-Slot Interchange |
| 中文描述： | 64通道全雙工H.100/H.110 CT總線系統(tǒng)接口和時隙交換 |
| 文件頁數(shù)： | 55/68頁 |
| 文件大?。?/td> | 696K |
| 代理商： | ML53612 |
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I
ML53612
I
51
Oki Semiconductor
Microprocessor Interface Timing - Motorola Bus Mode, Non-multiplexed Address
[1]
[2]
[3]
1.
2.
3.
Timing measured with 100 pF load on D_[7:0].
Write cycle may be controlled by CS_N or STRB_N.
AS=1.
Parameter
Symbol
Min
Typ
Max
Unit
CS_N setup to STRB_N
↑
t1
40
ns
STRB_N pulse width
t2
40
ns
R/W_N setup to STRB_N
↓
t3
5
ns
R/W_N hold from STRB_N
↑
t4
5
ns
A_[9:0] setup to STRB_N
↓
(C_96=1)
t5
5
ns
A_[2:0] setup to STRB_N
↑
(C_96=0)
t6
40
ns
A_[9:0] hold from STRB_N
↑
t7
5
ns
D_[7:0] setup to STRB_N
↑
t8
40
ns
D_[7:0] hold from STRB_N
↑
t9
5
ns
D_[7:0] float to valid delay from CS_N, STRB_N, and A_[9:0]
t10
0
50
ns
D_[7:0] valid to float delay from CS_N or STRB_N
t11
0
10
ns
Figure 8. Microprocessor Interface Timing - Motorola Bus Mode, Non-multiplexed Address
CS_N
STRB_N
R/W_N
A_[9:0]
D_[7:0]
t1
t3
t6
t5
t7
t9
t8
t10
t11
t2
t4
t3
t4
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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