參數(shù)資料
型號(hào)： PCI9060ES
廠商： Electronic Theatre Controls, Inc.
英文描述： 12O COMPATIBLE PCI BUS MASTER INTERFACE CHIP FOR ADAPTERS AND EMBEDDED SYSTEMS
中文描述： 12O兼容的PCI總線主控接口芯片的適配器和嵌入式系統(tǒng)
文件頁(yè)數(shù)： 68/192頁(yè)
文件大?。?/td> 1551K
代理商： PCI9060ES
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SECTION 4
PCI 9080
REGISTERS
PLX Technology, Inc., 1997
Page 59
Version 1.02
4.3.11 (PCIBAR1; PCI:14h, LOC:14h) PCI Base Address Register for I/O Accesses to Local,
Runtime, and DMA Registers
Table 4-20. (PCIBAR1; PCI:14h, LOC:14h) PCI Base Address Register for I/O Accesses to Local, Runtime, and
DMA Registers
Field
Description
Read
Write
Value after Reset
0
Memory Space Indicator. Value of 0 indicates register maps into memory space.
Value of 1 indicates register maps into I/O space.
Note:
Hardcoded to 1.
Yes
No
1
1
Reserved.
Yes
No
0
7:2
I/O Base Address. Base Address for I/O access to Local, Runtime, and DMA
registers. (Default is 256 bytes)
Note:
Hardcoded to 0.
Yes
No
0
31:8
I/O Base Address. Base Address for I/O access to Local, Runtime, and DMA
registers.
Yes
Yes
0
4.3.12 (PCIBAR2; PCI:18h, LOC:18h) PCI Base Address Register for Memory Accesses to
Local Address Space 0
Table 4-21. (PCIBAR2; PCI:18h, LOC:18h) PCI Base Address Register for Memory Accesses to Local Address
Space 0
Field
Description
Read
Write
Value after
Reset
0
Memory Space Indicator. Value of 0 indicates register maps into memory space.
Value of 1 indicates register maps into I/O space.
(Specified in LAS0RR register.)
Yes
No
0
2:1
Location of Register (If memory space). Location values:
00—Locate anywhere in 32 bit memory address space
01—Locate below 1 MB memory address space
10—Locate anywhere in 64 bit memory address space
11—Reserved
(Specified in LAS0RR register.)
If I/O Space, bit 1 is always 0 and bit 2 is included in the base address.
Yes
Mem: No
I/O:
bit 1 no,
bit 2 yes
0
3
Prefetchable (If memory space). Value of 1 indicates there are no side effects on
reads. This bit reflects the value of bit 3 in the LAS0RR register and provides only
status to the system. This bit has no effect on the operation of the PCI 9080.
Prefetching features of this address space are controlled by the associated Bus
Region Descriptor Register.
(Specified in LAS0RR register.)
If I/O Space, bit 3 is included in the base address.
Yes
Mem: No
I/O: Yes
0
31:4
Memory Base Address. Memory base address for access to Local Address Space
0.
Yes
Yes
0
Note:
PCIBAR2 can be enabled or disabled by setting or clearing bit 0 in the LAS0BA register.
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PDF描述
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PCI9060ESREV1 制造商:PLX Technology 功能描述:
PCI9060SD 制造商:未知廠家 制造商全稱:未知廠家 功能描述:12O COMPATIBLE PCI BUS MASTER INTERFACE CHIP FOR ADAPTERS AND EMBEDDED SYSTEMS
PCI9060SD-1AF 功能描述:數(shù)字總線開(kāi)關(guān) IC PCI Bus Interface RoHS:否 制造商:Texas Instruments 開(kāi)關(guān)數(shù)量:24 傳播延遲時(shí)間:0.25 ns 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:TSSOP-56 封裝:Reel
PCI9080 制造商:PLX 制造商全稱:PLX 功能描述:I2O Compatible PCI Bus Master I/O Accelerator Chip
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