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參數(shù)資料
| 型號： | PCI9060ES |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 12O COMPATIBLE PCI BUS MASTER INTERFACE CHIP FOR ADAPTERS AND EMBEDDED SYSTEMS |
| 中文描述： | 12O兼容的PCI總線主控接口芯片的適配器和嵌入式系統(tǒng) |
| 文件頁數(shù)： | 85/192頁 |
| 文件大?。?/td> | 1551K |
| 代理商： | PCI9060ES |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁當(dāng)前第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁
SECTION 4
PCI 9080
REGISTERS
PLX Technology, Inc., 1997
Page 76
Version 1.02
4.5.12 (CNTRL; PCI:6Ch, LOC:ECh) Serial EEPROM Control, PCI Command Codes, User I/O
Control, Init Control Register
Table 4-59. (CNTRL; PCI:6Ch, LOC:ECh) Serial EEPROM Control, PCI Command Codes, User I/O Control, Init
Control Register
Field
Description
Read
Write
Value after Reset
3:0
PCI Read Command Code for DMA. This PCI command is sent out during DMA
read cycles.
Yes
Yes
1110
7:4
PCI Write Command Code for DMA. This PCI command is sent out during DMA
write cycles.
Yes
Yes
0111
11:8
PCI Memory Read Command Code for Direct Master. This PCI command is sent
out during Direct Master read cycles.
Yes
Yes
0110
15:12
PCI Memory Write Command Code for Direct Master. This PCI command is sent
out during Direct Master write cycles.
Yes
Yes
0111
16
General Purpose Output. Value of 1 causes USERO output to go high. Value of 0
causes USER0 output to go low.
Yes
Yes
1
17
General Purpose Input. Value of 1 indicates USERI input pin is high. Value of 0
indicates USERI pin is low.
Yes
No
—
23:18
Reserved.
Yes
No
0
24
Serial EEPROM Clock for Local or PCI Bus Reads or Writes to serial EEPROM.
Toggling this bit generates a serial EEPROM clock. (Refer to the manufacturer’s
data sheet for the particular serial EEPROM being used.)
Yes
Yes
0
25
Serial EEPROM Chip Select. For local or PCI bus reads or writes to serial
EEPROM, setting this bit to 1 provides the serial EEPROM chip select.
Yes
Yes
0
26
Write Bit to serial EEPROM. For writes, this output bit is the input to the serial
EEPROM. Clocked into the serial EEPROM by the serial EEPROM clock.
Yes
Yes
0
27
Read serial EEPROM Data Bit. For reads, this input bit is the output of the serial
EEPROM. Clocked out of the serial EEPROM by the serial EEPROM clock.
Yes
No
—
28
Serial EEPROM Present. Value of 1 indicates a serial EEPROM is present.
Yes
No
0
29
Reload Configuration Registers. When this bit is set to 0, writing a 1 causes PCI
9080 to reload the local configuration registers from serial EEPROM.
Yes
Yes
0
30
PCI Adapter Software Reset. Value of 1 holds the local bus logic in the PCI 9080
reset and LRESETo# asserted. The contents of the PCI configuration registers and
Shared Run Time registers will not be reset. Software Reset can only be cleared
from the PCI bus. (Local bus remains reset until this bit is cleared.)
Yes
Yes
0
31
Local Init Status. Value of 1 indicates Local Init done. Responses to PCI accesses
are RETRYs until this bit is set. While input pin NB# is asserted low, this bit is
forced to 1.
Yes
Yes
0
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