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參數資料
| 型號： | PCI9060SD |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 12O COMPATIBLE PCI BUS MASTER INTERFACE CHIP FOR ADAPTERS AND EMBEDDED SYSTEMS |
| 中文描述： | 12O兼容的PCI總線主控接口芯片的適配器和嵌入式系統 |
| 文件頁數： | 26/192頁 |
| 文件大?。?/td> | 1551K |
| 代理商： | PCI9060SD |
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SECTION 3
PCI 9080
FUNCTIONAL DESCRIPTION
PLX Technology, Inc., 1997
Page 17
Version 1.02
3.4.1 PCI Bus Access to Internal Registers
PCI 9080 “PCI configuration registers” can be accessed
from the PCI bus with a configuration Type 0 cycle.
PCI 9080 internal registers can be accessed by a
memory cycle, with the PCI bus address that matches
the base address specified in the PCI Base Address 0
for Memory Mapped Configuration Register of PCI 9080.
They can also be accessed by an I/O cycle, with the PCI
bus address matching the base address specified in the
PCI Base Address 1 for I/O Mapped Configuration
Register of the PCI 9080.
All PCI read or write accesses to the PCI 9080 registers
can be byte, word, or Lword accesses. All PCI memory
accesses to the PCI 9080 registers can be burst or non-
burst. PCI 9080 responds with a PCI Disconnect for all
burst I/O accesses to PCI 9080 registers.
3.4.2 Local Bus Access to Internal
Registers
The local processor can access all the internal registers
of the PCI 9080 through either internal or external
address decode logic. PCI 9080 provides an Address
Decode Mode Pin (ADMODE) that selects whether the
internal address decode logic is used or whether the
designer will supply an external chip select from an
external address decoder. Figure 3-3 illustrates how the
dual address decode logic works.
If the Address Decode Mode pin is set to 1, internal PCI
9080 address decode logic is enabled. In this mode, PCI
9080 internal registers are selected when local address
bits LA[31:29] match input address select pins S[2:0]. If
the Address Decode Mode pin is set to 0, PCI 9080
responds to local bus access when S0 is asserted low
through external chip select logic.
Notes:
S0 must be decoded while ADS# is low.
If ADMODE is 1 LA[31:29], specify 512 MB of
local memory space allocated for accessing internal
registers.
All local read or write accesses to the PCI 9080 registers
can be byte, word, or Lword accesses. All local
accesses to the PCI 9080 registers can be burst or non-
burst.
For C and J modes, accesses must be for a 32 bit
nonpipelined bus. PCI 9080 READYo# indicates a data
transfer is complete.
For S mode, accesses must be for a 16 bit nonpipelined
bus. PCI 9080 READYo# indicates a data transfer is
complete.
0
Figure 3-3. Dual Address Decode Mode
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| PCI9080-3 G | 功能描述:外圍驅動器與原件 - PCI 32Bit Master Chip RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray |
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