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參數資料
| 型號： | PCI9060SD |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 12O COMPATIBLE PCI BUS MASTER INTERFACE CHIP FOR ADAPTERS AND EMBEDDED SYSTEMS |
| 中文描述： | 12O兼容的PCI總線主控接口芯片的適配器和嵌入式系統(tǒng) |
| 文件頁數： | 33/192頁 |
| 文件大?。?/td> | 1551K |
| 代理商： | PCI9060SD |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁當前第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁
SECTION 3
PCI 9080
FUNCTIONAL DESCRIPTION
PLX Technology, Inc., 1997
Page 24
Version 1.02
case when the Local Bus Latency Timer is enabled and
expires. (Refer to Figure 3-11 and Figure 3-12.)
; >; ,<
; -.
'
'
)
)=>) ;
&(); <);
-.
; >
Figure 3-11. Direct Slave Write
For direct slave writes, the PCI (Master) writes data to
the local bus (slave). Direct Slave is the “Command from
the PCI host,” which has the highest priority. Direct
Slave or Direct Master pre-empts DMA; however, Direct
Slave does not pre-empt Direct Master (refer to Section
3.6.2.3.1, “Backoff”).
; >; ,<;
>
; -
.
'
'
);
)=>)
&(); <);
-.
Figure 3-12. Direct Slave Read
For direct slave reads, the PCI (Master) reads data from
the local bus (Slave).
PCI 9080 supports on-the-fly Endian conversion for
Space 0, Space 1, and expansion ROM space. The local
bus can be Big/Little Endian by either using the
BIGEND# input pin or the programmable internal register
configuration. When BIGEND# is asserted, it overwrites
the internal register configuration.
Note:
PCI bus is always Little Endian.
3.6.2.2 PCI to Local Address Mapping
Note:
Not applicable if I
2
O mode.
Three local address spaces—Space 0, Space 1, and
expansion ROM—are accessible from the PCI bus. Each
is defined by a set of three registers:
Local Address Range
Local Base Address
PCI Base Address
A fourth register, Bus Region Descriptor Register for PCI
to local accesses, defines the local bus characteristics
for both regions. (Refer to Figure 3-13.)
3.6.2.2.1 Byte Enables
LBE[3:0]# (pins 139-142) are encoded based on the
configured bus width, as follows:
32-Bit Bus
—For a 32-bit bus, the four byte enables
indicate which of the four bytes are active during a data
cycle.
BE3# Byte Enable 3—LD[31:24]
BE2# Byte Enable 2—LD[23:16]
BE1# Byte Enable 1—LD[15:8]
BE0# Byte Enable 0—LD[7:0]
16-Bit Bus
—For a 16-bit bus, BE3#, BE1# and BE0#
are encoded to provide BHE#, LA1, and BLE#,
respectively.
BE3# Byte High Enable (BHE#)—LD[15:8]
BE2# not used
BE1# Address bit 1 (LA1)
BE0# Byte Low Enable (BLE#)— LD[7:0]
8-Bit Bus
—For an 8-bit bus, BE1# and BE0# are
encoded to provide LA1 and LA0, respectively.
BE3# not used
BE2# not used
BE1# Address bit 1 (LA1)
BE0# Address bit 0 (LA0)
Each PCI to Local Address space is defined as part of
reset initialization as described in the next section.
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| PCI9080-3 G | 功能描述:外圍驅動器與原件 - PCI 32Bit Master Chip RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray |
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