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參數(shù)資料
| 型號： | PEF22508E |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PBGA256 |
| 封裝： | 17 X 17 MM, 1 MM PITCH, PLASTIC, LBGA-256 |
| 文件頁數(shù)： | 164/193頁 |
| 文件大?。?/td> | 10683K |
| 代理商： | PEF22508E |
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OctalLIU
TM
PEF 22508 E
Functional Description
Data Sheet
72
Rev. 1.0, 2005-06-02
Figure 30
Transmit Line Interface
Similar to the receive line interface two different data types are supported:
Ternary Signal: Single-rail data is converted into a ternary signal which is output on pins XL1 and XL2.
Selection between B8ZS or simple AMI coding is provided.
Unipolar data on port XOID is transmitted in CMI code with or without (DIC3.CMI) preprocessed by B8ZS
coding or HDB3 precoding (MR3.CMI) to a fiber-optical interface. Clocking off data is done with the rising edge
of the transmit clock XCLK (1544 kHz) and with a programmable polarity. Selection is done by MR0.XC1 = 0
and LIM1.DRS = 1.
An overview of the transmit line coding is given in Table 12.
3.9.2
Transmit Clock TCLK
The transmit clock input TCLK (multi function port) of the OctalLIU
TM can be configured for 1.544, 3.088, 6.176,
12.352 and 24.704 MHz input frequency in T1/J1 mode and 2.048, 4.096, 8.192, 16.384 and 32.768 MHz input
frequency in E1 mode. Frequency selection is done by the register bits CMR6.STF(2:0) (CMR6). See divider “%”
in Figure 29.
3.9.3
Automatic Transmit Clock Switching
The transmit clock output XCLK can be derived from TCLK
Directly. In this case the TCLK frequency must be 32.768 MHz in E1 or 24.704 MHz in T1/J1 mode. or
With using the DCO-X, were the DCO-X reference is TCLK.
If TCLK fails, the transmit clock output XCLK will also fail. To avoid this, a so called automatic transmit clock
switching can be enabled by setting the register bit CMR6.ATCS (CMR6). Then FCLKX will be used instead of
TCLK if TCLK is lost. The transmit elastic buffer must be active. Automatically switching between TCLK and
FCLKX is done in the following both cases:
If the TCLK input is used directly as source for the transmit clock XCLK, the output of the DCO-X is not used.
The DCO-X reference clock is FCLKX. If loss of TCLK is detected, the transmit clock XCLK will be switched
automatically (if CMR6.ATCS = 1) to the DCO-X output which is synchronous to FCLKX (see multiplexer “H”
in Figure 29). If XCLK was switched to the DCO-X output and TCLK becomes active, switching of XCLK (back)
Table 23
Recommended Transmitter Configuration Values
R
SER (Ohm), accuracy +/- 1
%
Application Mode
PC6.TSRE
XL3, XL4
Operation
Mode
2
1)
1) The values in this column refers to an ideal transformer without any parasitics. Any transformer resistance or other parasitic
resistances have to be taken into account when calculating the final value of the output serial resistors.
Generic
1
Connected to
R
SER and
Xformer junction
E1
2
0
T1/J1
7.5
Non generic
0
Left open
E1
2
0
Left open
T1/J1
R
SER
R
SER
1%
XL3
XL1
XL4
XL2
t
2 : t 1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| PEF22554HT | DATACOM, FRAMER, PQFP144 |
| PES12-42S-N0024 | |
| PESD3V3V4UK,132 | 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE |
| PF38F3050L0YUQ3A | SPECIALTY MEMORY CIRCUIT, PBGA88 |
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