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參數(shù)資料
| 型號(hào)： | PI7C9X7954AFDE |
| 廠商： | Pericom |
| 文件頁(yè)數(shù)： | 46/70頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC PCIE-TO-UART BRIDGE 128LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 應(yīng)用： | PCIe至UART橋接 |
| 接口： | 高級(jí)配置電源接口（ACPI） |
| 電源電壓： | 1.8V, 3.3V |
| 封裝/外殼： | 128-LQFP 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 128-LQFP（14x14） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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PI7C9X7954
PCI Express Quad UART
Datasheet
Page 50 of 70
May 2013 – Revision 1.4
Pericom Semiconductor
BIT
FUNCTION
TYPE
DESCRIPTION
5
950 Mode
RW
1b: Enables 950 mode
0b: Non-950 mode
Reset to 0b.
6
RFD / LSR
Counter Select
RW
1b: OFFSET 15 bit[7:0] acts as the Line Status Register Counter
0b: OFFSET 15 bit[7:0] acts as the Receive FIFO Data Counter
Reset to 0b.
7
TFD / SCR Select
RW
1b: OFFSET 16 bit[7:0] acts as the Transmit FIFO Data Counter
0b: OFFSET 16 bit[7:0] acts as the Sample Clock Register
Reset to 0b.
7:6
Reserved
RW
Reset to 00b.
7.1.11. DIVISOR LATCH LOW REGISTER – OFFSET 00h, LCR[7] = 1
BIT
FUNCTION
TYPE
DESCRIPTION
7:0
Divisor Low
RW
Lower-part of the divisor register
Reset to 00h.
7.1.12. DIVISOR LATCH HIGH REGISTER – OFFSET 01h, LCR[7] = 1
BIT
FUNCTION
TYPE
DESCRIPTION
7:0
Divisor High
RW
Higher-part of the divisor register
Reset to 00h.
7.1.13. SAMPLE CLOCK REGISTER – OFFSET 02h, LCR[7] = 1
BIT
FUNCTION
TYPE
DESCRIPTION
3:0
Sample Clock
RW
This register determines the Sample Clock value (SC) used in
the Baud Rate Generator. Please refer to 5.2.12 Baud Rate
Generation for more detail
0000b: SC = 16
0001b: SC = 15
0010b: SC = 14
0011b: SC = 13
0100b: SC = 12
0101b: SC = 11
0110b: SC = 10
0111b: SC = 9
1000b: SC = 8
1001b: SC = 7
1010b: SC = 6
1011b: SC = 5
1100b: SC = 4
Other settings are
reserved.
Reset to 0h.
7:4
Reserve
R
Reset to 0h.
13-0093
相關(guān)PDF資料 |
PDF描述 |
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