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參數(shù)資料
| 型號： | Q67231-H1007 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | ICs for Communications |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 169/433頁 |
| 文件大小： | 3153K |
| 代理商： | Q67231-H1007 |
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PEB 20560
Functional Block Description
Semiconductor Group
2-123
2003-08
Input:
Output: DCL driven by selected PDC (PDC4, PDC8). ((ELIC0:CMD1:CSS = ‘1’)
and (CCSEL1[2] = ‘0’)) PDC4, 8 can be inputs or outputs, depends if the
DOC is master or slave.
Note
:
When DCL is input or driven directly from PDC4/8, it should be used as an
input by ELIC0 and ELIC1.
SACCO-B0 input clocks
– There are two SACCO-B0 clocks, HFS and HDC. Each one may be selected from
several possible sources as SACCO-B0 can be connected to the IOM signaling
mux, to the PCM signaling mux or directly to the IO when in stand-alone mode.
– HFS:
HFS sources:
PORT3/HFSB0 input pin, when disconnected from both PCM and IOM signaling
muxes.
FSC, when SACCO-B0 is connected to the IOM signaling mux.
PFS, when SACCO-B0 is connected to the PCM signaling mux.
– HDC:
HDC sources:
PDC2, PDC4, PDC8, DCL – when disconnected from both signaling muxes
(CCSEL1[5:4]). Each of these signals can be an inputs or an outputs, according to
the configuration.
PDC when SACCO-B0 is connected to the PCM signaling mux.
DCL when SACCO-B0 is connected to the IOM signaling mux.
SACCO-B1 clocks
– There are two SACCO-B1 clocks, HFS and HDC. Each one may be selected from
several possible sources, as SACCO-B1 can be connected to the IOM signaling
mux, to the PCM signaling mux or directly to the IO when in stand-alone mode.
– HFS:
HFS sources:
DU5/HFSB1 input pin – when disconnected from both signaling muxes.
FSC when SACCO-B1 is connected to the IOM signaling mux.
PFS when SACCO-B1 is connected to the PCM signaling mux.
– HDC:
HDC sources:
PDC2,PDC4,PDC8,DCL0 – when disconnected from both signaling muxes
(CCSEL1[7:6]). Each of these signals can be inputs or outputs, according to the
configuration.
PDC when SACCO-B1 is connected to the PCM signaling mux.
DCL when SACCO-B1 is connected to the IOM signaling mux.
SIDEC clocks
– The SIDEC module includes four HDLC controllers. Each one receives HDC and
HFS clocksfrom the IOM-2 interface.
– The HDC clocks are driven by DCL.
DCL driven by IO ((ELIC0:CMD1:CSS = ‘1’) and (CCSEL1[2] = ‘1’))
internal clocks
internal clocks
internal clocks
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