參數(shù)資料
型號： TMX320DM642GNZ500
廠商： TEXAS INSTRUMENTS INC
元件分類： 數(shù)字信號處理
英文描述： 64-BIT, 75.19 MHz, OTHER DSP, PBGA548
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, BGA-548
文件頁數(shù)： 154/181頁
文件大?。?/td> 2291K
代理商： TMX320DM642GNZ500
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Configuration Examples
74
July 2002 Revised March 2004
SPRS200E
McASP0 Data
McASP0 Control
PERCFG Register Value:
0x0000 007E
Extenal Pins:
PCI_EN = 0
GP0[3]/PCIEEAI = 0
HD5 = 0
TOUT0/MAC_EN = 1
Shading denotes a peripheral module not available for this configuration.
PCI
HPI
(16-Bit)
EMAC
MDIO
VP0
(10-Bit)
McBSP0
McBSP1
EMIFA
Clock
and
System
GP0
and
EXT_INT
I2C0
VP2
(20-Bit)
VIC
TIMER0
TIMER1
TIMER2
16
HD[15:0]
MTXD[3:0], MTXEN
MRXD[3:0], MRXER,
MRXDV, MCOL, MCRS,
MTCLK, MRCLK
MDIO, MDCLK
VP0CLK0
VP0CLK1,
VP0CTL[2:0],
VP0D[19:10]
VP1
(10-Bit)
VP1CLK0
VP1CLK1,
VP1CTL[2:0],
VP1D[19:10]
AED[63:0]
64
AECLKIN, AARDY, AHOLD
AEA[22:3], ACE[3:0], ABE[7:0],
AECLKOUT1, AECLKOUT2,
ASDCKE, ASOE3, APDT,
AHOLDA, ABUSREQ,
AARE/ASDCAS/ASADS/ASRE,
AAOE/ASDRAS/ASOE,
AAWE/ASDWE/ASWE
CLKIN,
CLKMODE0, CLKMODE1
CLKOUT4, CLKOUT6, PLLV
SCL0
SDA0
VP2CLK0
VP2CLK1,
VP2CTL[2:0],
VP2D[19:0]
TINP0
TOUT0/MACEN
TINP1
TOUT1/LENDIAN
STCLK
VDAC/GP0[8]/PCI66
HRDY, HINT
HCNTL0, HCNTL1,
HHWIL, HAS, HR/W,
HCS, HDS1, HDS2
GP0[15:9, 3:0]
GP0[7:4]
STCLK
CLKR0, FSR0, DR0,
CLKS0, DX0, FSX0,
CLKX0
CLKR1, FSR1, DR1,
CLKS1, DX1, FSX1,
CLKX1
STCLK supports all three video ports (VP2, VP1, and VP0)
Figure 28. Configuration Example B
(2 10-Bit Video Ports + 2 McBSPs + EMAC + MDIO + I2C0 + EMIF)
[Possible Video IP Phone Application]
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INFORMA
TION
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PDF描述
TN4002PM 10 MHz - 500 MHz RF/MICROWAVE WIDE BAND LOW POWER AMPLIFIER
TN5171PM 20 MHz - 150 MHz RF/MICROWAVE WIDE BAND MEDIUM POWER AMPLIFIER
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TOCP172-20CB 970/1000 um, MULTI MODE, SIMPLEX FIBER OPTIC CONNECTOR
TOD5202FE Optoelectronic
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