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參數(shù)資料
| 型號： | TMX320DM642GNZ500 |
| 廠商： | TEXAS INSTRUMENTS INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 64-BIT, 75.19 MHz, OTHER DSP, PBGA548 |
| 封裝： | 27 X 27 MM, 1 MM PITCH, PLASTIC, BGA-548 |
| 文件頁數(shù)： | 158/181頁 |
| 文件大?。?/td> | 2291K |
| 代理商： | TMX320DM642GNZ500 |
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Terminal Functions
78
July 2002 Revised March 2004
SPRS200E
Table 210. Terminal Functions (Continued)
SIGNAL
TYPE
IPD/
IPU
DESCRIPTION
NAME
NO.
TYPE
IPD/
IPU
DESCRIPTION
RESETS, INTERRUPTS, AND GENERAL-PURPOSE INPUT/OUTPUTS (CONTINUED)
GP0[7]/EXT_INT7
E1
I/O/Z
IPU
General-purpose input/output (GPIO) pins (I/O/Z) or external interrupts (input only).
The default after reset setting is GPIO enabled as input-only.
GP0[6]/EXT_INT6
F2
I/O/Z
IPU
General-purpose input/output (GPIO) pins (I/O/Z) or external interrupts (input only).
The default after reset setting is GPIO enabled as input-only.
When these pins function as External Interrupts [by selecting the corresponding
GP0[5]/EXT_INT5
F3
I/O/Z
IPU
When these pins function as External Interrupts [by selecting the corresponding
interrupt enable register bit (IER.[7:4])], they are edge-driven and the polarity can be
independently selected via the External Interrupt Polarity Register bits
GP0[4]/EXT_INT4
F4
I/O/Z
IPU
independently selected via the External Interrupt Polarity Register bits
(EXTPOL.[3:0]).
GP0[15]/PRST§
G3
General-purpose input/output (GP0) 15 pin (I/O/Z) or PCI reset (I). No function at
default.
GP0[14]/PCLK§
C1
GP0 14 pin (I/O/Z) or PCI clock (I). No function at default.
GP0[13]/PINTA§
G4
GP0 13 pin (I/O/Z) or PCI interrupt A (O/Z). No function at default.
GP0[12]/PGNT§
H4
GP0 12 pin (I/O/Z) or PCI bus grant (I). No function at default.
GP0[11]/PREQ§
F1
I/O/Z
GP0 11 pin (I/O/Z) or PCI bus request (O/Z). No function at default.
GP0[10]/PCBE3§
J2
I/O/Z
GP0 10 pin (I/O/Z) or PCI command/byte enable 3 (I/O/Z). No function at default.
GP0[9]/PIDSEL§
K3
GP0 9 pin (I/O/Z) or PCI initialization device select (I). No function at default.
GP0[3]/PCIEEAI
L5
IPD
GP0 3 pin (I/O/Z) and PCI EEPROM Auto-Initialization (EEAI).
If the PCI peripheral is disabled (PCI_EN pin = 0), this pin must not be pulled up.
0
PCI auto-initialization through EEPROM is disabled (default).
1
PCI auto-initialization through EEPROM is enabled.
GP0[0]
M5
I/O/Z
IPD
GP0 0 pin (I/O/Z) [default] or device selection (I) [default]
The general-purpose 0 pin (GP0[0]) (I/O/Z) can be programmed as GPIO 0 (input
only) [default] or as GP0[0] (output only) pin or output as a general-purpose interrupt
(GP0INT) signal (output only). This pin must remain low during device reset.
VDAC/
GP0[8]/PCI66§
AD1
I/O/Z
IPD
VCXO Interpolated Control Port (VIC) single-bit digital-to-analog converter (VDAC)
output [output only] [default] or this pin can be programmed as a GP0 8 pin (I/O/Z) or
PCI frequency selection (PCI66).
If the PCI peripheral is enabled (PCI_EN pin = 1), then:
0
PCI operates at 66 MHz (default).
1
PCI operates at 33 MHz.
The -500 device supports PCI at 33 MHz only. For proper -500 device operation when
the PCI peripheral is enabled (PCI_EN = 1), this pin must be pulled up with a a 1-k
resistor at device reset.
If the PCI peripheral is disabled (PCI_EN pin = 0), this pin must not be pulled up.
CLKOUT6/
GP0[2]§
C6
I/O/Z
IPD
Clock output at 1/6 of the device speed (O/Z) [default] or this pin can be programmed as
a GP0 2 pin (I/O/Z).
CLKOUT4/
GP0[1]§
D6
I/O/Z
IPD
Clock output at 1/4 of the device speed (O/Z) [default] or this pin can be programmed as
a GP0 1 pin (I/O/Z).
HOST-PORT INTERFACE (HPI) OR PERIPHERAL COMPONENT INTERCONNECT (PCI) OR EMAC
PCI_EN
E2
I
IPD
PCI enable pin. This pin and the MAC_EN pin control the selection (enable/disable) of
the HPI, EMAC, MDIO, and GP0[15:8], or PCI peripherals. The pins work in conjunction
to enable/disable these peripherals (for more details, see the Device Configurations
section of this data sheet).
HINT/PFRAME§
N4
I/O/Z
Host interrupt from DSP to host (O) [default] or PCI frame (I/O/Z)
I = Input, O = Output, Z = High impedance, S = Supply voltage, GND = Ground
IPD = Internal pulldown, IPU = Internal pullup. (These IPD/IPU signal pins feature a 30-k IPD or IPU resistor. To pull up a signal to the opposite
supply rail, a 1-k
resistor should be used.)
§ These pins are multiplexed pins. For more details, see the Device Configurations section of this data sheet.
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INFORMA
TION
相關(guān)PDF資料 |
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| TOCP172-1MB | 970/1000 um, MULTI MODE, SIMPLEX FIBER OPTIC CONNECTOR |
| TOCP172-20CB | 970/1000 um, MULTI MODE, SIMPLEX FIBER OPTIC CONNECTOR |
| TOD5202FE | Optoelectronic |
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| TMX320DM6437BZDUA | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC Dig Media Processor RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
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