參數(shù)資料
型號(hào)： XRT74L73
廠商： Exar Corporation
英文描述： 3 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
中文描述： 三通道，自動(dòng)取款機(jī)統(tǒng)一/平價(jià)DS3/E3，界定控制器
文件頁(yè)數(shù)： 83/488頁(yè)
文件大?。?/td> 2829K
代理商： XRT74L73
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XRT74L73
3 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
PRELIMINARY
REV. P1.0.1
84
The following sections discuss each functional
sub-block of the Transmit UTOPIA Interface Block in
detail. These sections will discuss the many features
associated with the Transmit UTOPIA Interface block
as well as how to select/configure these features in
order to suit particular application needs. Detailed
discussion of Single-PHY and Multi-PHY operation
will each be presented in its own section even though
it involves the use of all of these functional blocks.
2.1.2.1Transmit UTOPIA Bus Input Interface
The Transmit UTOPIA input interface complies with
UTOPIA Level 2 standard interface (e.g., the Transmit
UTOPIA can support both Single-PHY and Multi-PHY
operations.) Additionally, the UNI provides the option
of varying the following features associated with the
Transmit UTOPIA Bus Interface.
Transmit UTOPIA Data Bus width of 8 or 16 bits
The cell size (e.g., the number of octets being
processed per cell via the UTOPIA bus)
The handling of errored cells received from the
ATM Layer processor
A discussion of the operation of the Transmit UTOPIA Bus
Interface along with each of these options will be presented
below.
2.1.2.1.1The Pins of the Transmit UTOPIA Bus
Interface
The ATM Layer processor will interface to the Transmit
UTOPIA Interface block via the following pins.
TxUData[15:0]—Transmit UTOPIA Data Bus Input
pins
TxUAddr[4:0]—Transmit UTOPIA Address Bus
Input pins
TxUClk—Transmit UTOPIA Interface block clock
input pin
TxUSoC—Transmit “Start of Cell” indicator input
pin
TxUPrty—Transmit UTOPIA—Odd Parity Input pin
TxUEn
—Transmit UTOPIA Data Bus—Write
Enable input pin
TxUClav—TxFIFO Cell Available
Each of these signals are briefly discussed below.
F
IGURE
4. F
UNCTIONAL
B
LOCK
D
IAGRAM
OF
THE
T
RANSMIT
UTOPIA B
LOCK
TxUData [7:0]
TxUSoC
Tx Utopia
FIFO Manager
TxUtopia
Registers
D[15:0]
A[8:0]
Status Signals
Control Signals
Tx Utopia
Cell FIFO
TxUSoC
TxUClk
TxUtopia Interrupt
TxUClav
Controls from
Registers
(To Pin)
(To Interrupt block)
Microprossor
Interface
TxCel Present (to Tx Cell Processor
Status Bits to Registers
To Tx Cell Processor
TxFRdClk
TRdEn
TxUEn
TxUAddr [4:0]
TxUData [15:0]
TxUData [7:0]
相關(guān)PDF資料
PDF描述
XRT74L73IB 3 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT74L74 4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT74L74IB 4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT75L00D E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L00DIV E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
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參數(shù)描述
XRT74L73IB 制造商:EXAR 制造商全稱:EXAR 功能描述:3 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT74L74 制造商:EXAR 制造商全稱:EXAR 功能描述:4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT74L74IB 制造商:EXAR 制造商全稱:EXAR 功能描述:4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT75L00 制造商:EXAR 制造商全稱:EXAR 功能描述:E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER ATTENUATOR
XRT75L00D 制造商:EXAR 制造商全稱:EXAR 功能描述:E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
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