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參數(shù)資料
| 型號： | 28F128 |
| 廠商： | Intel Corp. |
| 英文描述： | 3 Volt Intel StrataFlash Memory |
| 中文描述： | 3伏特英特爾StrataFlash存儲器 |
| 文件頁數(shù)： | 51/58頁 |
| 文件大?。?/td> | 380K |
| 代理商： | 28F128 |
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28F128J3A, 28F640J3A, 28F320J3A
Preliminary
45
6.5
AC Characteristics
—
Read-Only Operations
(1,2)
NOTES:
CE
X
low is defined as the first edge of CE
0
, CE
1
, or CE
2
that enables the device. CE
X
high is defined at the first edge of CE
0
,
CE
1
, or CE
2
that disables the device (see
Table 2
).
1. See AC Input/Output Reference Waveforms for the maximum allowable input slew rate.
2. OE# may be delayed up to t
ELQV
-t
GLQV
after the first edge of CE
0
, CE
1
, or CE
2
that enables the device (see
Table 2
) without impact on t
.
3. See Figures 14
–
16, Transient Input/Output Reference Waveform for V
= 3.0 V
–
3.6 V or V
CCQ
= 2.7 V
–
3.6 V, and Transient Equivalent Testing Load Circuit for testing characteristics.
4. When reading the flash array a faster t
GLQV
(R16) applies. Non-array reads refer to status register reads,
query reads, or device identifier reads.
5. Sampled, not 100% tested.
6. For devices configured to standard word/byte read mode, R15 (t
APA
) will equal R2 (t
AVQV
).
Versions
(All units in ns unless otherwise noted)
V
CC
3.0 V
–
3.6 V
(3)
2.7 V
–
3.6 V
(3)
V
CCQ
3.0 V
–
3.6 V
(3)
2.7 V
–
3.6 V
(3)
#
Sym
Parameter
Notes
Min
Max
Min
Max
R1
t
AVAV
Read/Write Cycle Time
32 Mbit
110
110
64 Mbit
120
120
128 Mbit
150
150
R2
t
AVQV
Address to Output Delay
32 Mbit
110
110
64 Mbit
120
120
128 Mbit
150
150
R3
t
ELQV
CE
X
to Output Delay
32 Mbit
2
110
110
64 Mbit
2
120
120
128 Mbit
2
150
150
R4
t
GLQV
OE# to Non-Array Output Delay
2, 4
50
50
R5
t
PHQV
RP# High to Output Delay
32 Mbit
150
150
64 Mbit
180
180
128 Mbit
210
210
R6
t
ELQX
CE
X
to Output in Low Z
5
0
0
R7
t
GLQX
OE# to Output in Low Z
5
0
0
R8
t
EHQZ
CE
X
High to Output in High Z
5
55
55
R9
t
GHQZ
OE# High to Output in High Z
5
15
15
R10
t
OH
Output Hold from Address, CE
X
, or OE# Change,
Whichever Occurs First
5
0
0
R11
t
ELFL/
t
ELFH
CE
X
Low to BYTE# High or Low
5
10
10
R12
t
FLQV/
t
FHQV
BYTE# to Output Delay
1000
1000
R13
t
FLQZ
BYTE# to Output in High Z
5
1000
1000
R14
t
EHEL
CEx High to CEx Low
5
0
0
R15
t
APA
Page Address Access Time
5, 6
25
30
R16
t
GLQV
OE# to Array Output Delay
4
25
30
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