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參數(shù)資料
| 型號： | 79RC32V333-100DH |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 173/654頁 |
| 文件大?。?/td> | 6963K |
| 代理商： | 79RC32V333-100DH |
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IDT Bus Arbitration
Theory of Operation
79RC32438 User Reference Manual
5 - 5
November 4, 2002
Notes
Figure 5.2 IPBus Arbitration Algorithm Flow Chart
*The fairness bit is used internally by the arbiter and is not visible to software
any bus master requesting
ownership of the bus with a
non-zero CMTC
any bus master requesting
ownership of the bus with a
zero CMTC
Grant ownership to the master with highest priority that is
requesting the bus. If multiple bus masters share the highest
priority, then choose one in a fair manner as follows:
a Select the bus master with the lowest index that
has highest priority, is requesting ownership of the
bus, and does not have its fairness bit set.*
b If all of these bus masters have their fairness bit
set, then clear the fairness bit of all bus masters
with highest priority and go back to step a.
Set the fairness bit of the bus master that is granted ownership
of the bus.
Decrement the CPTC of all priorities.
Decrement the CPTC of all priorities.
looping done
START
is CPTC for priority p equal
to zero
loop through all priorities
p = 0 through 3
Set the CPTC for priority p equal to its corresponding PTC.
For all bus masters with priority p, set their CMTC equal to the
corresponding MTC.
If the MF bit in the corresponding IPAPxC register is cleared,
then for all bus masters with priority p, clear the bus master’s
fairness bit.*
YES
NO
YES
NO
YES
YES
NO
NO
has the bus been
idle for 16 clock cycles
YES
NO
Grant ownership to the bus master with highest priority that is
requesting the bus and has a non-zero CMTC. If multiple
masters share these characteristics, then grant the bus to the
master that currently owns the bus. If none of the masters with
these characteristics currently own the bus, then grant the bus
to the master with the lowest index.
Decrement the CMTC of the bus master that was granted the
bus.
Decrement the CPTC of all priorities higher than or equal to the
priority of the master that was granted the bus.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 79RC32V333-100DHI | 8-Pin, 1.5KB Flash Program, 64B Flash Data, 8MHz Internal Oscillator, -40C to +85C, 8-DFN, T/R |
| 79RC32V333-133DH | 8-pin, 1.5KB Flash Program, 64B Flash Data, 8MHz Internal Oscillator, -40C to +85C, 8-SOIC 150mil, T/R |
| 79RC32V333-133DHI | Microprocessor |
| 79RC32V333-150DH | 8 PIN, 1.75KB, FLASH, 64B RAM, COMPARATOR, 8MHZ INTERNAL OSCILLATOR, -40C to +125C, 8-PDIP, TUBE |
| 79RC32V333-150DHI | Microprocessor |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| 79RC32V333-100DHI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32V333-133DH | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32V333-133DHI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32V333-150DH | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32V333-150DHI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
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