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參數(shù)資料
| 型號： | 82801FBM |
| 廠商： | Intel Corp. |
| 英文描述： | Intel I/O Controller Hub 6 (ICH6) Family |
| 中文描述： | 英特爾I / O控制器集線器6（ICH6）家庭 |
| 文件頁數(shù)： | 308/462頁 |
| 文件大?。?/td> | 3450K |
| 代理商： | 82801FBM |
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LPC Interface Bridge Registers (D31:F0)
9-62
Intel
82801BA ICH2 Datasheet
9.8.3.3
PM1_CNT—Power Management 1 Control Register
I/O Address:
PMBASE + 04h
(
ACPI PM1a_CNT_BLK)
0000h
No
Bits 0–7: Core,
Bits 8–15: Resume
Attribute:
Size:
Usage:
R/W
32-bit
ACPI or Legacy
Default Value:
Lockable:
Power Well:
9.8.3.4
PM1_TMR—Power Management 1 Timer Register
I/O Address:
PMBASE + 08h
(
ACPI PMTMR_BLK)
Attribute:
Size:
Usage:
RO
32-bit
ACPI
Default Value:
Lockable:
Power Well:
xx000000h
No
Core
Bit
Description
13
Sleep Enable (SLP_EN)—
WO.
Setting this bit causes the system to sequence into the Sleep state
defined by the SLP_TYP field.
12:10
Sleep Type (SLP_TYP)
—R/W. This 3-bit field defines the type of Sleep the system should enter
when the SLP_EN bit is set to 1.
000 = ON: Typically maps to S0 state.
001 = Assert STPCLK#. Puts processor in Stop-Grant state. Optional to assert CPUSLP# to put
processor in sleep state: Typically maps to S1 state.
010 = Reserved
011 = Reserved
100 = Reserved
101 = Suspend-To-RAM. Assert SLP_S1# and SLP_S3#; typically, maps to S3 state.
110 = Suspend-To-Disk. Assert SLP_S1#, SLP_S3#, and SLP_S5# SLP_S3# and, SLP_S5#;
typically, maps to S4 state.
111 = Soft Off. Assert SLP_S1#, SLP_S3#, and SLP_S5# SLP_S3#, and SLP_S5#; typically, maps
to S5 state.
2
Global Release (GBL_RLS)
—WO.
1 = ACPI software writes a 1 to this bit to raise an event to the BIOS. BIOS software has
corresponding enable and status bits to control its ability to receive ACPI events.
0 = This bit always reads as 0.
1
Reserved
0
SCI Enable (SCI_EN)
—R/W. Selects the SCI interrupt or the SMI# interrupt for various events
including the bits in the PM1_STS register (bit 10, 8, 0), and bits in GPE0_STS.
0 = These events will generate an SMI#.
1 = These events will generate an SCI.
Bit
Description
31:24
Reserved
23:0
Timer Value (TMR_VAL)
—RO. Returns the running count of the PM timer. This counter runs off a
3.579545 MHz clock (14.31818 MHz divided by 4). It is reset to zero during a PCI reset and then
continues counting as long as the system is in the S0 state.
Anytime bit 22 of the timer goes HIGH to LOW (bits referenced from 0 to 23), the TMROF_STS bit is
set. The High-to-Low transition will occur every 2.3435 seconds. If the TMROF_EN bit is set, an SCI
interrupt is also generated.
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 82801FR | Intel I/O Controller Hub 6 (ICH6) Family |
| 82801DB | Intel 82801DB I/O Controller Hub 4 (ICH4) |
| 82801AA | 82801AB (ICH0) I/O Controller Hub |
| 82801AB | 82801AB (ICH0) I/O Controller Hub |
| 82803AAMRH-R | Controller Miscellaneous - Datasheet Reference |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 82801FR | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 6 (ICH6) Family |
| 82801GBICH7 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GBMICH7-M | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GDHICH7DH | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GHMICH7-MDH | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
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