參數(shù)資料
型號(hào)： 82801FBM
廠商： Intel Corp.
英文描述： Intel I/O Controller Hub 6 (ICH6) Family
中文描述： 英特爾I / O控制器集線器6（ICH6）家庭
文件頁(yè)數(shù)： 314/462頁(yè)
文件大?。?/td> 3450K
代理商： 82801FBM
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LPC Interface Bridge Registers (D31:F0)
9-68
Intel
82801BA ICH2 Datasheet
9.8.3.10
GPE1_EN—General Purpose Event 1 Enable Register
I/O Address:
PMBASE + 2Eh
(
ACPI GPE1_BLK + 2)
0000h
No
Resume
Attribute:
Size:
Usage:
R/W
16-bit
ACPI
Default Value:
Lockable:
Power Well:
Note:
This register is symmetrical to the General Purpose Event 1 Status Register. GPIOs that are not
implemented will not have the corresponding bits implemented in this register. All of the bits in
this register will be cleared by RSMRST#.
Note:
Bits 5 and 2 are not implemented since GPIO5 and GPIO2 are not implemented.
9.8.3.11
SMI_EN—SMI Control and Enable Register
I/O Address:
Default Value:
Lockable:
Power Well:
PMBASE + 30h
0000h
No
Core
Attribute:
Size:
Usage:
R/W
32 bit
ACPI or Legacy
Bit
Description
15:6
GPI[15:6] Enable (GPI[15:6]_EN)
—R/W.
1 = Enable the corresponding GPI[n]_STS bit being set to cause an SMI#, SCI, and/or wake event.
0 = Disable.
5
Reserved
4:3
GPI[4:3] Enable (GPI[4:3]_EN)
—R/W.
1 = Enable the corresponding GPI[n]_STS bit being set to cause an SMI#, SCI, and/or wake event.
0 = Disable.
2
Reserved
1:0
GPI[1:0] Enable (GPI[1:0]_EN
)—R/W.
1 = Enable the corresponding GPI[n]_STS bit being set to cause an SMI#, SCI, and/or wake event.
0 = Disable.
Bit
Description
31:15
Reserved
14
Periodic SMI# Enable (PERIODIC_EN
)—R/W.
0 = Disable.
1 = Enables the ICH2 to generate an SMI# when the PERIODIC_STS bit is set in the SMI_STS
register.
13
TCO Enable (TCO_EN)
—R/W.
0 = Disables TCO logic generating an SMI#. Note that if the NMI2SMI_EN bit is set, SMIs that are
caused by re-routed NMIs will not be gated by the TCO_EN bit. Even if the TCO_EN bit is 0,
NMIs will still be routed to cause SMIs.
1 = Enables the TCO logic to generate SMI#.
12
Reserved
11
Microcontroller SMI# Enable (MCSMI_EN)
—R/W.
0 = Disable.
1 = Enables ICH2 to trap accesses to the microcontroller range (62h or 66h) and generate an
SMI#. Note that ’trapped’ cycles will be claimed by the ICH2 on PCI, but not forwarded to LPC.
10:8
Reserved
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相關(guān)PDF資料
PDF描述
82801FR Intel I/O Controller Hub 6 (ICH6) Family
82801DB Intel 82801DB I/O Controller Hub 4 (ICH4)
82801AA 82801AB (ICH0) I/O Controller Hub
82801AB 82801AB (ICH0) I/O Controller Hub
82803AAMRH-R Controller Miscellaneous - Datasheet Reference
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
82801FR 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 6 (ICH6) Family
82801GBICH7 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7
82801GBMICH7-M 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7
82801GDHICH7DH 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7
82801GHMICH7-MDH 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7
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