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參數(shù)資料
| 型號： | 82801FBM |
| 廠商： | Intel Corp. |
| 英文描述： | Intel I/O Controller Hub 6 (ICH6) Family |
| 中文描述： | 英特爾I / O控制器集線器6（ICH6）家庭 |
| 文件頁數(shù)： | 313/462頁 |
| 文件大?。?/td> | 3450K |
| 代理商： | 82801FBM |
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Intel
82801BA ICH2 Datasheet
9-67
LPC Interface Bridge Registers (D31:F0)
9.8.3.9
GPE1_STS—General Purpose Event 1 Status Register
I/O Address:
PMBASE + 2Ch
(
ACPI GPE1_BLK)
0000h
No
Resume
Attribute:
Size:
Usage:
R/WC
16-bit
ACPI
Default Value:
Lockable:
Power Well:
Note:
This register is symmetrical to the General Purpose Event 1 Enable Register. GPIOs that are not
implemented will not have the corresponding bits implemented in this register.
Note:
Bits 5 and 2 are not implemented since GPIO5 and GPIO2 are not implemented.
Bit
Description
15:6
GPI[15:6] Status (GPI[15:6]_STS)
—R/WC.
0 = Software clears each bit by writing a 1 to the bit position when the corresponding GPIO signal
is not active. (The status bit cannot be cleared while the corresponding signal is still active).
1 = These bits are set any time the corresponding GPIO is set up as an input and the
corresponding GPIO signal is low (or high if the corresponding GP_INV bit is set).
If the corresponding GPI[n]_EN bit is set in the GPE1_EN register, and the GPI[n]_STS bit is
set, then:
- If the system is in an S1_S5 state, the event will also wake the system.
- If the system is in an S0 state (or upon waking back to an S0 state), an SMI# or SCI will be
generated, depending on the GPI_ROUT bits for the corresponding GPI.
5
Reserved
4:3
GPI[4:3] Status (GPI[4:3]_STS)
—R/WC.
0 = Software clears each bit by writing a 1 to the bit position when the corresponding GPIO signal
is not active. (The status bit cannot be cleared while the corresponding signal is still active).
1 = These bits are set any time the corresponding GPIO is set up as an input and the
corresponding GPIO signal is low (or high if the corresponding GP_INV bit is set).
If the corresponding GPI[n]_EN bit is set in the GPE1_EN register, and the GPI[n]_STS bit is
set, then:
- If the system is in an S1_S5 state, the event will also wake the system.
- If the system is in an S0 state (or upon waking back to an S0 state), an SMI# or SCI will be
generated, depending on the GPI_ROUT bits for the corresponding GPI.
2
Reserved
1:0
GPI[1:0] Status (GPI[1:0]_STS)
—R/WC.
0 = Software clears each bit by writing a 1 to the bit position when the corresponding GPIO signal
is not active. (The status bit cannot be cleared while the corresponding signal is still active).
1 = These bits are set any time the corresponding GPIO is set up as an input and the
corresponding GPIO signal is low (or high if the corresponding GP_INV bit is set).
If the corresponding GPI[n]_EN bit is set in the GPE1_EN register, and the GPI[n]_STS bit is
set, then:
- If the system is in an S1_S5 state, the event will also wake the system.
- If the system is in an S0 state (or upon waking back to an S0 state), an SMI# or SCI will be
generated, depending on the GPI_ROUT bits for the corresponding GPI.
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PDF描述 |
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| 82803AAMRH-R | Controller Miscellaneous - Datasheet Reference |
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參數(shù)描述 |
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