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參數(shù)資料
| 型號： | 82801FBM |
| 廠商： | Intel Corp. |
| 英文描述： | Intel I/O Controller Hub 6 (ICH6) Family |
| 中文描述： | 英特爾I / O控制器集線器6（ICH6）家庭 |
| 文件頁數(shù)： | 443/462頁 |
| 文件大小： | 3450K |
| 代理商： | 82801FBM |
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Intel
82801BA ICH2 Datasheet
A-1
I/O Register Index
I/O Register Index
A
Table A-1. ICH2 Fixed I/O Registers
Register Name
Port
EDS Section and Location
Channel 0 DMA Base & Current
Address Register
00h
Section 9.2.1, “DMABASE_CA—DMA Base and Current
Address Registers” on page 9-24
Channel 0 DMA Base & Current
Count Register
01h
Section 9.2.2, “DMABASE_CC—DMA Base and Current
Count Registers” on page 9-25
Channel 1 DMA Base & Current
Address Register
02h
Section 9.2.1, “DMABASE_CA—DMA Base and Current
Address Registers” on page 9-24
Channel 1 DMA Base & Current
Count Register
03h
Section 9.2.2, “DMABASE_CC—DMA Base and Current
Count Registers” on page 9-25
Channel 2 DMA Base & Current
Address Register
04h
Section 9.2.1, “DMABASE_CA—DMA Base and Current
Address Registers” on page 9-24
Channel 2 DMA Base & Current
Count Register
05h
Section 9.2.2, “DMABASE_CC—DMA Base and Current
Count Registers” on page 9-25
Channel 3 DMA Base & Current
Address Register
06h
Section 9.2.1, “DMABASE_CA—DMA Base and Current
Address Registers” on page 9-24
Channel 3 DMA Base & Current
Count Register
07h
Section 9.2.2, “DMABASE_CC—DMA Base and Current
Count Registers” on page 9-25
Channel 0–3 DMA Command
Register
Channel 0–3 DMA Status Register
08h
Section 9.2.4, “DMACMD—DMA Command Register”
on page 9-26
Section 9.2.5, “DMASTS—DMA Status Register” on
page 9-26
Channel 0–3 DMA Write Single
Mask Register
0Ah
Section 9.2.6, “DMA_WRSMSK—DMA Write Single
Mask Register” on page 9-27
Channel 0–3 DMA Channel Mode
Register
0Bh
Section 9.2.7, “DMACH_MODE—DMA Channel Mode
Register” on page 9-27
Channel 0–3 DMA Clear Byte
Pointer Register
0Ch
Section 9.2.8, “DMA Clear Byte Pointer Register” on
page 9-28
Channel 0–3 DMA Master Clear
Register
0Dh
Section 9.2.9, “DMA Master Clear Register” on
page 9-28
Channel 0–3 DMA Clear Mask
Register
0Eh
Section 9.2.10, “DMA_CLMSK—DMA Clear Mask
Register” on page 9-28
Channel 0–3 DMA Write All Mask
Register
0Fh
Section 9.2.11, “DMA_WRMSK—DMA Write All Mask
Register” on page 9-29
Aliased at 00h–0Fh
10h–1Fh
Master PIC ICW1 Init. Cmd Word 1
Register
Master PIC OCW2 Op Ctrl Word 2
Register
Master PIC OCW3 Op Ctrl Word 3
Register
20h
Section 9.4.2, “ICW1—Initialization Command Word 1
Register” on page 9-34
Section 9.4.8, “OCW2—Operational Control Word 2
Register” on page 9-37
Section 9.4.9, “OCW3—Operational Control Word 3
Register” on page 9-38
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 82801FR | Intel I/O Controller Hub 6 (ICH6) Family |
| 82801DB | Intel 82801DB I/O Controller Hub 4 (ICH4) |
| 82801AA | 82801AB (ICH0) I/O Controller Hub |
| 82801AB | 82801AB (ICH0) I/O Controller Hub |
| 82803AAMRH-R | Controller Miscellaneous - Datasheet Reference |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 82801FR | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 6 (ICH6) Family |
| 82801GBICH7 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GBMICH7-M | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GDHICH7DH | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GHMICH7-MDH | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
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