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參數(shù)資料
| 型號(hào)： | 82801FR |
| 廠商： | Intel Corp. |
| 英文描述： | Intel I/O Controller Hub 6 (ICH6) Family |
| 中文描述： | 英特爾I / O控制器集線器6（ICH6）家庭 |
| 文件頁(yè)數(shù)： | 378/462頁(yè) |
| 文件大?。?/td> | 3450K |
| 代理商： | 82801FR |
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AC’97 Audio Controller Registers (D31:F5)
13-8
Intel
82801BA ICH2 Datasheet
NOTE:
1. Registers in bold are multiplexed between audio and modem functions
2. Software should not try to access reserved registers
The Bus Master registers are located from offset + 00h to offset + 51h and reside in the AC ‘97
controller. Accesses to these registers do NOT cause the cycle to be forwarded over the AC-link to
the codec.
In the case of the split codec implementation accesses to the different codecs are differentiated by
the controller by using address offsets 00h–7Fh for the primary codec and address offsets 80h–FEh
for the secondary codec.
The Global Control (GLOB_CNT) and Global Status (GLOB_STA) registers are aliased to the
same global registers in the audio and modem I/O space. Therefore a read/write to these registers in
either audio or modem I/O space affects the same physical register.
Bus Mastering registers exist in I/O space and reside in the AC ‘97 controller. The three channels
(PCM in, PCM out, and Mic in) each have their own set of Bus Mastering registers. The following
register descriptions apply to all three channels. The register definition section titles use a generic
“x_” in front of the register to indicate that the register applies to all three channels. The naming
prefix convention used in
Table 13-3
and in the register description I/O address is as follows:
PI = PCM in channel
PO = PCM out channel
MC = Mic in channel.
2Ch
ACh
PCM Front DAC Rate
2Eh
AEh
PCM Surround DAC Rate
30h
B0h
PCM LFE DAC Rate
32h
B2h
34h
B4h
MIC ADC Rate
36h
B6h
6Ch Vol: C, LFE Mute
38h
B8h
6Ch Vol: L, R Surround Mute
3Ah:56h
BAh–F6h
Intel RESERVED
58h
1
Vendor Reserved
7Ah
1
Vendor Reserved
7Ch
1
Vendor ID1
7Eh
1
Vendor ID2
Table 13-2. ICH2 Audio Mixer Register Configuration (Continued)
Primary
offset
Secondary
Offset
NAMBAR Exposed Registers (D31:F5)
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 82801DB | Intel 82801DB I/O Controller Hub 4 (ICH4) |
| 82801AA | 82801AB (ICH0) I/O Controller Hub |
| 82801AB | 82801AB (ICH0) I/O Controller Hub |
| 82803AAMRH-R | Controller Miscellaneous - Datasheet Reference |
| 82804AA | Interface IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 82801GBICH7 | 制造商:INTEL 制造商全稱(chēng):Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GBMICH7-M | 制造商:INTEL 制造商全稱(chēng):Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GDHICH7DH | 制造商:INTEL 制造商全稱(chēng):Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GHMICH7-MDH | 制造商:INTEL 制造商全稱(chēng):Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GRICH7R | 制造商:INTEL 制造商全稱(chēng):Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
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