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參數(shù)資料
| 型號(hào)： | HY5R288HC |
| 英文描述： | -|2.5V|8K|40|Direct RDRAM - 288M |
| 中文描述： | - |為2.5V | 8K的| 40 |直接RDRAM的- 288M |
| 文件頁數(shù)： | 46/64頁 |
| 文件大?。?/td> | 4542K |
| 代理商： | HY5R288HC |
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46
Rev.0.9/Dec.2000
Direct RDRAM
256/288-Mbit (512Kx16/18x32s) Preliminary
Electrical Conditions
.
a VCMOS must remain on as long as VDD is applied and cannot be turned off.
b.VDIH is typically equal to VTERM(1.8V+/- 0.1V) under DC conditions in a system.
c. Voltage undershoot is limited to -0.7V for a duration of less than 5ns.
d. Voltage overshoot is limited to VCMOS + 0.7V for a duration of less than 5ns.
Table 17: Electrical Conditions
Symbol
Parameter and Conditions
Min
Max
Unit
T
J
Junction temperature under bias
-
100
°
C
V
DD,
V
DDA
Supply voltage
2.50 - 0.13
2.50 + 0.13
V
V
DD,N,
V
DDA,N
Supply voltage droop (DC) during NAP interval (t
NLIMIT
)
-
2.0
%
v
DD,N,
v
DDA,N
Supply voltage ripple (AC) during NAP interval (t
NLIMIT
)
-2.0
2.0
%
V
CMOS
Supply voltage for CMOS pins (2.5V controllers)
V
DD
V
DD
V
Supply voltage for CMOS pins (1.8V controllers)
1.80 - 0.1
1.80 + 0.2
V
V
REF
Reference voltage
1.40 - 0.2
1.40 + 0.2
V
V
DIL
RSL data input - low voltage
V
REF
- 0.5
V
REF
- 0.2
V
V
DIH
RSL data input - high voltage
V
REF
+ 0.2
V
REF
+ 0.5
V
R
DA
RSL data asymmetry: R
DA
= (V
DIH
- V
REF
) / (V
REF
- V
DIL
)
0.67
1.0
-
V
CM
RSL clock input - common mode V
CM
= (V
CIH
- V
CIL
)/2
1.3
1.8
V
V
CIS,CTM
RSL clock input swing: V
CIS
= V
CIH
- V
CIL
(CTM,CTMN pins).
0.35
1.0
V
V
CIS,CFM
RSL clock input swing: V
CIS
= V
CIH
- V
CIL
(CFM,CFMN pins).
0.225
1.0
V
V
IL,CMOS
CMOS input low voltage
- 0.3
c
V
CMOS
/2 - 0.25
V
V
IH,CMOS
CMOS input high voltage
V
CMOS
/2 + 0.25
V
CMOS
+0.3
d
V
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PDF描述 |
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