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參數(shù)資料
| 型號： | IDT88P8344BHGI |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPI EXCHANGE 4 x SPI-3 TO SPI-4 Issue 1.0 |
| 中文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA820 |
| 封裝： | GREEN, PLASTIC, BGA-820 |
| 文件頁數(shù)： | 35/98頁 |
| 文件大小： | 601K |
| 代理商： | IDT88P8344BHGI |
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35
IDT88P8344 SPI EXCHANGE 4 x SPI-3 TO SPI-4
INDUSTRIAL TEMPERATURE RANGE
APRIL 10, 2006
4.4.2 Microprocessor insert to SPI-3 egress
datapath
The diagrambelow shows the datapath through the device fromthe
mcroprocessor data insert interface to a SPI-3 egress port.
The following is a description of the path taken by a fragment of data through
the device.
Data and control information are written to the insert buffer through the
mcroprocessor interface. The data available bit is set. Data is stored along with
its LP address, LID (including SPI-3 choice), error information, SOP, and EOP.
Data is stored in LID-allocated buffer segments. The Table 80, SPI-3 egress
port descriptor table (64 entries) is consulted and the PFP decides to move the
data to the SPI-3 egress port. The SPI-3 packet fragment processor chooses
the next LP. The choice of LP is dependent on the status of the LP and the
availability of a complete fragment. Data is moved to a SPI-3 egress buffer along
with its LP address. SPI-3 LP address, error information, SOP, and EOP.
Data is transmtted in packet fragments over the selected SPI-3 egress
interface.
Figure 25. Mcroprocessor interface to SPI-3 egress detailed datapath diagram
…
…
JTAG
uproc
LID Counters Memory
4 x SPI-3
8 bit / 32 bit
Min: 19.44MHz
Max: 133MHz
I
Chip Counters Memory
I
SPI-3 /
LID map
Main
Memory
A
SPI-4.2
Min: 80 MHz
Max:400 MHz
SPI-4 /
LID map
6370 drw16
Figure 24 . Mcroprocessor data insert buffer
6370 drw28
flags
length
data[1]
data[2]
data[255]
lid
data[0]
SOP
EA
ED
PAR
EOP
not used
EA
ED
PAR
data parity error
address parity error
packet error
7
0
i
t
t+1
t+258
e
t
t+1
t+258
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PDF描述 |
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