參數(shù)資料
型號： M16C62P
廠商： Mitsubishi Electric Corporation
英文描述： SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
中文描述： 單片16位CMOS微機
文件頁數(shù)： 252/349頁
文件大?。?/td> 5388K
代理商： M16C62P
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Electrical Characteristics (Vcc
1
≥
Vcc
2
= 3V)
251
Mitsubishi microcomputers
M16C / 62P Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
V
CC1
≥
V
CC2
= 3V
development
Preliminary Specifications Rev.1.0
Specifications in this manual are tentative and subject to change.
Switching Characteristics
(V
CC1
= V
CC2
= 3V, V
SS
= 0V, at Topr =
–
20 to 85
o
C /
–
40 to 85
o
C, CM15=
“
1
”
unless otherwise
specified)
Figure 1.26.11
Table 1.26.46. Memory expansion and Microprocessor Modes
(for 2- to 3-wait setting, external area access and multiplex bus selection)
Symbol
Standard
Min.
Measuring condition
Max.
50
Parameter
Unit
t
d(BCLK-AD)
t
h(BCLK-AD)
t
h(RD-AD)
t
h(WR-AD)
Address output delay time
Address output hold time (refers to BCLK)
Address output hold time (refers to RD)
Address output hold time (refers to WR)
ns
ns
ns
ns
4
t
d(BCLK-CS)
t
h(BCLK-CS)
t
h(RD-CS)
t
h(WR-CS)
Chip select output delay time
Chip select output hold time (refers to BCLK)
Chip select output hold time (refers to RD)
Chip select output hold time (refers to WR)
50
ns
ns
ns
ns
4
(Note 1)
t
d(BCLK-RD)
t
h(BCLK-RD)
t
d(BCLK-WR)
t
h(BCLK-WR)
RD signal output delay time
RD signal output hold time
WR signal output delay time
WR signal output hold time
40
ns
ns
ns
ns
0
(Note 1)
40
t
d(BCLK-DB)
t
h(BCLK-DB)
t
d(DB-WR)
Data output delay time (refers to BCLK)
Data output hold time (refers to BCLK)
Data output delay time (refers to WR)
50
ns
ns
ns
4
(Note 2)
t
d(BCLK-ALE)
t
h(BCLK-ALE)
t
d(AD-ALE)
ALE signal output delay time (refers to BCLK)
ALE signal output hold time (refers to BCLK)
ALE signal output delay time (refers to Address)
40
ns
ns
ns
– 4
t
h(ALE-AD)
t
d(AD-RD)
t
d(AD-WR)
t
dZ(RD-AD)
Note 1: Calculated according to the BCLK frequency as follows:
ALE signal output hold time (refers to Adderss)
RD signal output delay from the end of Address
WR signal output delay from the end of Address
Address output floating start time
30
0
0
ns
ns
ns
ns
0
(Note 1)
8
t
h(WR-DB)
Data output hold time (refers to WR)
ns
(Note 1)
f(BCLK)
0.5 X 10
9
[ns]
(Note 3)
Note 2: Calculated according to the BCLK frequency as follows:
f(BCLK)
(n–0.5) X 10
9
–50
[ns]
Note 3: Calculated according to the BCLK frequency as follows:
f(BCLK)
0.5 X 10
9
–40
[ns]
n is “2” for 2-wait setting, “3” for 3-wait setting.
(Note 1)
相關(guān)PDF資料
PDF描述
M16C SR BTS PC 13 ASY C
M1951A VOLTAGE DETECTING,SYSTEM RESETTING IC SERIES
M1951B VOLTAGE DETECTING,SYSTEM RESETTING IC SERIES
M1952A VOLTAGE DETECTING,SYSTEM RESETTING IC SERIES
M1952B VOLTAGE DETECTING,SYSTEM RESETTING IC SERIES
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
M16C62P_06 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:16-BIT SINGLE-CHIP MICROCOMPUTER M16C FAMILY / M16C/60 SERIES
M16C62PT 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:16-BIT SINGLE-CHIP MICROCOMPUTER M16C FAMILY / M16C/60 SERIES
M16C63 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU
M16C64 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU M16C FAMILY / M16C/60 SERIES
M16C64C 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:cameras, televisions, household appliances, office equipment
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