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參數(shù)資料
| 型號： | M16C62P |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER |
| 中文描述： | 單片16位CMOS微機 |
| 文件頁數(shù)： | 85/349頁 |
| 文件大?。?/td> | 5388K |
| 代理商： | M16C62P |
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Mitsubishi microcomputers
M16C / 62P Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
Interrupts
84
development
Preliminary Specifications Rev.1.0
Specifications in this manual are tentative and subject to change.
Interrupt sources
7
Level that is set to IPL
Watchdog timer, NMI
Software, address match, DBC, single-step
Not changed
Variation of IPL when Interrupt Request is Accepted
When a maskable interrupt request is accepted, the interrupt priority level of the accepted interrupt is set
in the IPL.
When a software interrupt or special interrupt request is accepted, one of the interrupt priority levels listed
in Table 1.11.5 is set in the IPL. Shown in Table 1.11.5 are the IPL values of software and special
interrupts when they are accepted.
Table 1.11.5. IPL Level That is Set to IPL When A Software or Special Interrupt Is Accepted
Instruction
Interrupt sequence
Instruction in
interrupt routine
Time
Interrupt response time
(a)
(b)
Interrupt request acknowledged
Interrupt request generated
(a) A time from when an interrupt request is generated till when the instruction then
executing is completed. The length of this time varies with the instruction being
executed. The DIVX instruction requires the longest time, which is equal to 30 cycles
(without wait state, the divisor being a register).
(b) A time during which the interrupt sequence is executed. For details, see the table
below. Note, however, that the values in this table must be increased 2 cycles for the
DBC interrupt and 1 cycle for the address match and single-step interrupts.
Interrupt vector address
Even
Even
Odd
Odd
SP value
Even
Odd
Even
Odd
16-Bit bus, without wait
18 cycles
19 cycles
19 cycles
20 cycles
8-Bit bus, without wait
20 cycles
20 cycles
20 cycles
20 cycles
Figure 1.11.5. Interrupt response time
Interrupt Response Time
Figure 1.11.5 shows the interrupt response time. The interrupt response or interrupt acknowledge time
denotes a time from when an interrupt request is generated till when the first instruction in the interrupt
routine is executed. Specifically, it consists of a time from when an interrupt request is generated till when
the instruction then executing is completed ((a) in Figure 1.11.5) and a time during which the interrupt
sequence is executed ((b) in Figure 1.11.5).
相關PDF資料 |
PDF描述 |
|---|---|
| M16C | SR BTS PC 13 ASY C |
| M1951A | VOLTAGE DETECTING,SYSTEM RESETTING IC SERIES |
| M1951B | VOLTAGE DETECTING,SYSTEM RESETTING IC SERIES |
| M1952A | VOLTAGE DETECTING,SYSTEM RESETTING IC SERIES |
| M1952B | VOLTAGE DETECTING,SYSTEM RESETTING IC SERIES |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| M16C62P_06 | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:16-BIT SINGLE-CHIP MICROCOMPUTER M16C FAMILY / M16C/60 SERIES |
| M16C62PT | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:16-BIT SINGLE-CHIP MICROCOMPUTER M16C FAMILY / M16C/60 SERIES |
| M16C63 | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
| M16C64 | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU M16C FAMILY / M16C/60 SERIES |
| M16C64C | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:cameras, televisions, household appliances, office equipment |
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