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參數(shù)資料
| 型號(hào)： | MC68341FT25 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 25.16 MHz, MICROPROCESSOR, PQFP160 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 30/514頁 |
| 文件大?。?/td> | 2891K |
| 代理商： | MC68341FT25 |
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4- 18
MC68341 USER’S MANUAL
MOTOROLA
corresponding bits in the PPARB for a particular signal, the port B pins can be configured
for different pin functions. Upon reset, port B is configured as IRQ7–IRQ1, MODCK.
Table 4-6. Port B Pin Assignment Register
Pin Function
Signal
PPARB = 0
PPARB = 1
IRQ7
PORTB7
IRQ7
IRQ6
PORTB6
IRQ6
IRQ5
PORTB5
IRQ5
IRQ4
PORTB4
IRQ4
IRQ3
PORTB3
IRQ3
IRQ2
PORTB2
IRQ2
IRQ1
PORTB1
IRQ1
IRQ0
PORTB0
MODCK
NOTE: MODCK has no function after reset.
4.2.6 Low-Power Stop
Executing the LPSTOP instruction provides reduced power consumption when the
MC68341 is idle; only the SIM41 remains active. Operation of the SIM41 clock and
CLKOUT during LPSTOP is controlled by the STSIM and STEXT bits in the SYNCR (see
Table 4-3). LPSTOP disables the clock to the software watchdog in the low state. The
software watchdog remains stopped until the LPSTOP mode ends; it begins to run again
on the next rising clock edge.
NOTE
When the CPU32 executes the STOP instruction (as opposed
to LPSTOP), the software watchdog continues to run. If the
software watchdog is enabled, it issues a reset or interrupt
when timeout occurs.
The periodic interrupt timer and real time clock do not respond to an LPSTOP instruction;
thus, they can be used to exit LPSTOP as long as their interrupt request level is higher
than the CPU32 interrupt mask level. To stop the periodic interrupt timer while in LPSTOP,
the PITR must be loaded with a zero value before LPSTOP is executed. The bus monitor,
double bus fault monitor, and spurious interrupt monitor are all inactive during LPSTOP.
The STP bit in the MCR of each on-chip module (DMA, timer, and serial modules) should
be set prior to executing the LPSTOP instruction. Setting the STP bit stops all clocks
within each of the modules, except for the clock from the IMB. The clock from the IMB
remains active to allow the CPU32 access to the MCR of each module. The system clock
stops on the low phase of the clock and remains stopped until the STP bit is cleared by
the CPU32 or until reset. For more information, see the description of the MCR STP bit for
each module.
F
re
e
sc
a
le
S
e
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n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MC68360RC25VC | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CPGA241 |
| MC68EN360FE25C | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CQFP240 |
| MC68EN360ZP25C | 32-BIT, 25 MHz, RISC MICROCONTROLLER, PBGA357 |
| MC68EN360CRC25C | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CPGA241 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68341UMAD | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Users Manual |
| MC68349 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HIGH PERFORMANCE INTEGRATED PROCESSOR |
| MC68349FT25A | 制造商:Motorola Inc 功能描述: |
| MC68349V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HIGH PERFORMANCE INTEGRATED PROCESSOR |
| MC6835 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-BIT MPUS, 8-BIT MCUS, 8-BIT PERIPHERALS |
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