MCF5272 ColdFire Integrated Microprocessor User’s Manual, Rev. 3 Fr" />
參數(shù)資料
型號： MCF5272VF66J
廠商： Freescale Semiconductor
文件頁數(shù)： 8/544頁
文件大?。?/td> 0K
描述： IC MCU 32BIT 66MHZ 196-MAPBGA
標(biāo)準(zhǔn)包裝： 126
系列： MCF527x
核心處理器： Coldfire V2
芯體尺寸： 32-位
速度： 66MHz
連通性： EBI/EMI，以太網(wǎng)，I²C，SPI，UART/USART，USB
外圍設(shè)備： DMA，WDT
輸入/輸出數(shù)： 32
程序存儲器容量： 16KB（4K x 32）
程序存儲器類型： ROM
RAM 容量： 1K x 32
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
振蕩器型： 外部
工作溫度： 0°C ~ 70°C
封裝/外殼： 196-LBGA
包裝： 托盤
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Local Memory
MCF5272 ColdFire Integrated Microprocessor User’s Manual, Rev. 3
Freescale Semiconductor
4-3
4.3.2.1
SRAM Base Address Register (RAMBAR)
RAMBAR determines the base address location of the internal SRAM module, as well as the definition of
the types of accesses allowed for it.
RAMBAR is a 32-bit write-only supervisor control register. It is accessed in the CPU address space
via the MOVEC instruction with an Rc encoding of 0xC04. RAMBAR can be read or written in
background debug mode (BDM). At system reset, the V bit is cleared and the remaining bits are
uninitialized. To access the SRAM module, RAMBAR must be written with the appropriate base
address after system reset.
The SRAM base address register (RAMBAR) can be accessed only in supervisor mode using the
MOVEC instruction with an Rc value of 0xC04.
Figure 4-1. SRAM Base Address Register (RAMBAR)
RAMBAR fields are described in Table 4-2.
31
12 11
9
8
7
6
5
4
3
2
1
0
Field
BA
—
WP
—
C/I SC SD UC UD V
Reset
—
0
R/W
W for CPU; R/W for debug
Address
CPU space + 0xC04
Table 4-2. RAMBAR Field Description
Bits
Name
Description
31–12
BA
Base address. SRAM module base address. The SRAM module occupies a 4-Kbyte space defined
by BA. SRAM can reside on any 4-Kbyte boundary in the 4-Gbyte address space.
11–9
—
Reserved, should be cleared.
8
WP
Write protect. Controls read/write properties of the SRAM.
0 Allows read and write accesses to the SRAM module.
1 Allows only read accesses to the SRAM module. Any attempted write reference generates an
access error exception to the ColdFire processor core.
7–6
—
Reserved, should be cleared.
5–1
C/I,
SC,
SD,
UC, UD
Address space masks (ASn). These fields allow certain types of accesses to be masked, or inhibited
from accessing the SRAM module. These bits are useful for power management as described in
Section 4.3.2.3, “Programming RAMBAR for Power Management.” In particular, C/I is typically set.
The address space mask bits are follows:
C/I = CPU space/interrupt acknowledge cycle mask. Note that C/I must be set if BA = 0.
SC = Supervisor code address space mask
SD = Supervisor data address space mask
UC = User code address space mask
UD = User data address space mask
For each ASn bit:
0 An access to the SRAM module can occur for this address space
1 Disable this address space from the SRAM module. References to this address space cannot
access the SRAM module and are processed like other non-SRAM references.
0
V
Valid. Enables/disables the SRAM module. V is cleared at reset.
0 RAMBAR contents are not valid.
1 RAMBAR contents are valid.
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PDF描述
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參數(shù)描述
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MCF5272VM66 功能描述:微處理器 - MPU 66MHz 63MIPS RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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