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參數(shù)資料
| 型號： | ML60852 |
| 廠商： | OKI SEMICONDUCTOR CO., LTD. |
| 英文描述： | USB Device Controller |
| 中文描述： | USB設(shè)備控制器 |
| 文件頁數(shù)： | 54/81頁 |
| 文件大小： | 451K |
| 代理商： | ML60852 |
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PEDL60852-01
1
Semiconductor
ML60852
54/81
EP0 Control Register (EP0CONT)
Address
Type
Access type
0 x 48
Bit map
Read/Write
D7
0
0
0
D6
0
0
0
D5
0
0
0
D4
x
x
D3
0
0
0
D2
0
0
0
D1
x
x
D0
0
0
After a hardware reset
After a bus reset
Definition
Stall bit:
During EP0 reception (data stage of a control write transfer), if a packet with a number
of bytes exceeding the maximum packet size specified in EP0PLD is received (or if the
EOP packet is missing), the ML60852 automatically sets this bit to “1”. In order to
conform to the Protocol Stall of USB Rev. 1.1, this bit is reset automatically to “0” when
a setup packet is received.
Data sequence toggle bits: The ML60852 automatically carries out synchronization using the data sequence toggle
mechanism. Further, any write operation to these bits (D4 and D1) will be invalid.
Stall bit
(R/W)
Data sequence toggle bit
(reception)
Data sequence toggle bit
(transmission)
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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