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參數資料
| 型號： | ML60852 |
| 廠商： | OKI SEMICONDUCTOR CO., LTD. |
| 英文描述： | USB Device Controller |
| 中文描述： | USB設備控制器 |
| 文件頁數： | 79/81頁 |
| 文件大?。?/td> | 451K |
| 代理商： | ML60852 |
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PEDL60852-01
1
Semiconductor
ML60852
79/81
DMA Transfer Timing (8)
Memory to ML60852 (Demand Transfer, Dual Address Mode)
Parameter
Symbol
t
1
t
2
t
3
t
4
t
5
Condition
Load 20 pF
FIFO WRITE
Min.
—
42
0
30
5
63
Max.
20
—
—
—
—
—
Unit
ns
ns
ns
ns
ns
ns
Note
DREQ
Disable Time
FIFO Access Time
CS
Hold Time
Write Data Setup Time
Write Data Hold Time
(1)
8-bit DMA
(2)
Recovery Time
t
6
16-bit DMA
105
—
ns
(3)
Notes: (1) When in Dual Address mode, the DACK is ignored.
A7: A0 specifies the FIFO address.
Refer to WRITE Timing (1) for Address Setup Time and Address Hold Time.
t
2
is defined depending on
CS
or
WR
which becomes active last.
(2) 3-clock time of oscillation clock (clock period: 21 ns).
(3) 5-clock time of oscillation clock (clock period: 21 ns).
DREQ
DIN
WR
CS
A7: A0
t
4
t
3
t
5
t
6
t
2
t
1
(Note) Refer to the previous page.
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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