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參數(shù)資料
| 型號(hào)： | MNSC140CORE |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | Quad Core 16-Bit Digital Signal Processor |
| 中文描述： | 四核16位數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 57/88頁(yè) |
| 文件大小： | 983K |
| 代理商： | MNSC140CORE |
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AC Timings
MSC8122 Technical Data, Rev. 13
Freescale Semiconductor
2-23
2.5.10.2 MII Mode Timing
2.5.10.3 RMII Mode
Table 2-24.
MII Mode Signal Timing
No.
Characteristics
Min
Max
Unit
803
804
805
ETHRX_DV, ETHRXD[0–3], ETHRX_ER to ETHRX_CLK rising edge set-up time
ETHRX_CLK rising edge to ETHRX_DV, ETHRXD[0–3], ETHRX_ER hold time
ETHTX_CLK to ETHTX_EN, ETHTXD[0–3], ETHTX_ER output delay
1.1 V core
1.2 V core
3.5
3.5
—
—
ns
ns
1
1
14.6
12.6
ns
ns
Figure 2-18.
MII Mode Signal Timing
Table 2-25.
RMII Mode Signal Timing
No.
Characteristics
1.1 V Core
1.2 V Core
Unit
Min
Max
Min
Max
806
ETHTX_EN,ETHRXD[0–1], ETHCRS_DV, ETHRX_ER to ETHREF_CLK rising
edge set-up time
ETHREF_CLK rising edge to ETHRXD[0–1], ETHCRS_DV, ETHRX_ER hold
time
ETHREF_CLK rising edge to ETHTXD[0–1], ETHTX_EN output delay.
1.6
—
2
—
ns
807
1.6
—
1.6
—
ns
811
3
12.5
3
11
ns
Figure 2-19.
RMII Mode Signal Timing
Valid
ETHRX_CLK
ETHRX_DV
ETHRXD[0–3]
ETHRX_ER
ETHTX_CLK
ETHTX_EN
ETHTXD[0–3]
ETHTX_ER
Valid
Valid
803
804
805
Valid
ETHREF_CLK
ETHCRS_DV
ETHRXD[0–1]
ETHRX_ER
807
806
ETHTX_EN
ETHTXD[0–1]
Valid
Valid
811
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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