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參數(shù)資料
| 型號(hào)： | MNSC140CORE |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | Quad Core 16-Bit Digital Signal Processor |
| 中文描述： | 四核16位數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 58/88頁(yè) |
| 文件大?。?/td> | 983K |
| 代理商： | MNSC140CORE |
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MSC8122 Technical Data, Rev. 13
2-24
Freescale Semiconductor
Specifications
2.5.10.4 SMII Mode
2.5.11 GPIO Timing
Table 2-26.
SMII Mode Signal Timing
No.
Characteristics
Min
Max
Unit
808
ETHSYNC_IN, ETHRXD to ETHCLOCK rising edge set-up time
1.0
—
ns
809
ETHCLOCK rising edge to ETHSYNC_IN, ETHRXD hold time
1.0
—
ns
810
ETHCLOCK rising edge to ETHSYNC, ETHTXD output delay
1.1 V core.
1.2 V core.
1.5
1
1.5
1
6.0
2
5.0
2
ns
ns
Notes:
1.
2.
Measured using a 5 pF load.
Measured using a 15 pF load.
Figure 2-20.
SMII Mode Signal Timing
Table 2-27.
GPIO Timing
No.
Characteristics
Ref = CLKIN
Ref = CLKOUT
(1.2 V only)
Unit
Min
Max
Min
Max
601
602
603
604
605
REFCLK edge to GPIO out valid (GPIO out delay time)
REFCLK edge to GPIO out not valid (GPIO out hold time)
REFCLK edge to high impedance on GPIO out
GPIO in valid to REFCLK edge (GPIO in set-up time)
REFCLK edge to GPIO in not valid (GPIO in hold time)
—
1.1
—
3.5
0.5
6.1
—
5.4
—
—
—
1.3
—
3.7
0.5
6.9
—
6.2
—
—
ns
ns
ns
ns
ns
Valid
ETHCLOCK
ETHSYNC_IN
ETHRXD
ETHSYNC
ETHTXD
Valid
Valid
810
809
808
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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