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參數(shù)資料
| 型號： | MSM7630 |
| 廠商： | OKI SEMICONDUCTOR CO., LTD. |
| 英文描述： | Universal Speech Processor(通用語音處理器) |
| 中文描述： | 通用語音處理器（通用語音處理器） |
| 文件頁數(shù)： | 81/89頁 |
| 文件大?。?/td> | 430K |
| 代理商： | MSM7630 |
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MSM7630
Semiconductor
81/89
5.2 Divided Clock Mode
In divided clock mode counting begins from the value set in the Timer Initial Value Register, and the
divided clock output value inverts when the counter overflows.
1) Set the TCMR (Command Register) TCG bit to "0", disabling counting.
2) Set TCMR’s TCS bits to select the counter’s increment clock.
3) Set TCMR’s TMOD bit to "1", setting divided clock mode as the operating mode.
4) To generate a periodic divided clock set TCMR’s TCAI bit to "1", which will set the counter to be
loaded with the value of the Timer Initial Value Register each time the counter overflows. For a
one-shot divided clock set the TCAI bit to "0".
5) Set the timer’s initial value in the Timer Initial Value Register TIR. Writing to this register will
simultaneously write the same value to the Timer Value Register TCR.
6) Write "1" to TCMR’s TCG bit to start counting and generating a divided clock.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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