參數(shù)資料
型號： PEF22554HT
廠商： INFINEON TECHNOLOGIES AG
元件分類： 數(shù)字傳輸電路
英文描述： DATACOM, FRAMER, PQFP144
封裝： GREEN, PLASTIC, LBGA-160
文件頁數(shù)： 648/700頁
文件大?。?/td> 25742K
代理商： PEF22554HT
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QuadFALC
TM
PEF 22554 E
Operational Description
Data Sheet
682
Rev. 1.2, 2006-01-26
Note: Read access to unused register addresses: value should be ignored. Write access to unused register
addresses: should be avoided, or set to 00
H. All control registers (except XFIFO, XS(12:1), CMDR, DEC)
are of type read/write
Specific T1/J1 Configuration
The following is a suggestion for a basic configuration to meet most of the T1/J1 requirements. Depending on
different applications and requirements any other configuration can be used.
Framing additions
FMR1.CRC, FMR0.SRAF
Synchronization mode
FMR4.AUTO, FMR4.SSC(1:0), FMR2.MCSP, FMR2.SSP
Signaling mode
FMR5.EIBR, XC0.BRM, MODE, MODE2, MODE3, CCR1, CCR2,
RAH(2:1), RAL(2:1)
Table 175
Line Interface Configuration (T1/J1)
Register
Function
FMR0.XC0/1
FMR0.RC0/1
LIM1.DRS
CCB(3:1)
SIC3.CMI
The QuadFALC
TM supports requirements for the analog line interface as well as the
digital line interface. For the analog line interface the codes AMI (with and without bit
7stuffing) and B8ZS are supported. For the digital line interface modes (dual- or
single-rail) the QuadFALC
TM supports AMI (with and without bit 7 stuffing), B8ZS (with
and without B8ZS precoding) and NRZ.
PCD = 0A
H
LOS detection after 176 consecutive “zeros” (fulfills G.775/Telcordia (Bellcore)/AT&T)
PCR = 15
H
LOS recovery after 22 “ones” in the PCD interval (fulfills G.775, Bellcore/AT&T).
LIM1.RIL(2:0) = 02
H
LOS threshold of 0.6 V (fulfills G.775).
GCR.SCI = 1
Additional Recovery Interrupts. Help to meet alarm activation and deactivation
conditions in time.
LIM2.LOS1 = 1
Automatic pulse-density check on 15 consecutive zeros for LOS recovery condition
(Bellcore requirement)
Table 176
Framer Configuration (T1/J1)
Register
Function
T1
J1
FMR4.SSC(1:0)
Selection of framing sync conditions
FMR4.FM(1:0)
Select framing format
FMR2.AXRA = 1
The transmission of RAI via the line interface is done automatically by the
QuadFALC
TM in case of Loss of Frame Alignment (FRS0.LFA = 1). If framing has
been reinstalled RAI is automatically reset
FMR4.AUTO = 1
Automatic synchronization in case of definite framing candidate (FRS0.FSRF).
In case of multiple framing candidates and CRC6 errors different resynchronization
conditions can be programmed via FMR2.MCSP/SSP.
RCO.SJR
1) =1
FMR0.SRAF = 0
Remote alarm handling via DL-channel
according to ITU-T JG.704 using pattern
1111111111111111
B
RCO.SJR = 0
CRC6 calculation without FS/DL-bits
RCO.SJR = 1
CRC6 calculation including FS/DL-bits
Table 174
Configuration Parameters (T1/J1) (cont’d)
Basic Set Up
T1
J1
相關(guān)PDF資料
PDF描述
PES12-42S-N0024
PESD3V3V4UK,132 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE
PF38F3050L0YUQ3A SPECIALTY MEMORY CIRCUIT, PBGA88
PFC04108.2UHKT 1 ELEMENT, 8.2 uH, GENERAL PURPOSE INDUCTOR
PFC04101.8UHKT 1 ELEMENT, 1.8 uH, GENERAL PURPOSE INDUCTOR
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
PEF22554HT V2.1 制造商:Infineon Technologies AG 功能描述:
PEF22554HTV2.1 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
PEF22554H-TV2.1 制造商:Infineon Technologies AG 功能描述:
PEF22554HT-V2.1 制造商:Infineon Technologies AG 功能描述:PEF22554HT-V2.1
PEF22554HTV3.1 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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