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參數(shù)資料
| 型號(hào)： | PEF22554HT |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | DATACOM, FRAMER, PQFP144 |
| 封裝： | GREEN, PLASTIC, LBGA-160 |
| 文件頁數(shù)： | 651/700頁 |
| 文件大?。?/td> | 25742K |
| 代理商： | PEF22554HT |
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Data Sheet
685
Rev. 1.2, 2006-01-26
QuadFALC
TM
PEF 22554 E
Signaling Controller Operating Modes
12
Signaling Controller Operating Modes
The three HDLC controllers can be programmed to operate in various modes, which are different in the treatment
of the HDLC frame in receive direction. Thus, the receive data flow and the address recognition features can be
performed in a very flexible way, to satisfy almost any practical requirements.
There are 4 different operating modes which can be set via the mode registers (MODE, MODE2 and MODE3).
If not mentioned otherwise, all functions described for HDLC channel 1 apply to channel 2 and 3 as well.
12.1
HDLC Mode
All frames with valid addresses are forwarded directly via the RFIFO to the system memory.
Depending on the selected address mode, the QuadFALC
TM can perform a 1- or 2-byte address recognition
(MODE.MDS0).
If a 2-byte address field is selected, the high address byte is compared to the fixed value FEH or FCH (group
address) as well as with two individually programmable values in RAH1 and RAH2 registers. According to the
ISDN LAPD protocol, bit 1 of the high byte address is interpreted as command/response bit (C/R) and is excluded
from the address comparison.
Similarly, two compare values can be programmed in special registers (RAL1, RAL2) for the low address byte. A
valid address is recognized in case the high and low byte of the address field correspond to one of the compare
values. Thus, the QuadFALC
TM can be called (addressed) with 6 different address combinations. HDLC frames
with address fields that do not match any of the address combinations, are ignored by the QuadFALC
TM.
In case of a 1-byte address, RAL1 and RAL2 are used as compare registers. The HDLC control field, data in the
I-field and an additional status byte are temporarily stored in the RFIFO. Additional information can also be read
from a special register (RSIS).
As defined by the HDLC protocol, the QuadFALC
TM performs the zero bit insertion/deletion (bit stuffing) in the
transmit/receive data stream automatically. That means, it is guaranteed that at least one “0” will appear after 5
consecutive “1”s.
12.1.1
Non-Auto Mode
(MODE.MDS(2:1) = 01
B; MODE2.MDS22.21 =01B; MODE3.MDS32.31 =01B)
Characteristics: address recognition, flag- and CRC generation/check, bit stuffing
All frames with valid addresses are forwarded directly via the RFIFO (RFIFO2, RFIFO3) to the system memory.
12.1.2
Transparent Mode 1
(MODE.MDS(2:0) = 101
B; MODE2.MDS2(2:0) = 101B; MODE3.MDS3(2:0) = 101B)
Characteristics: address recognition, flag- and CRC generation/check, bit stuffing
Only the high byte of a 2-byte address field is compared to registers RAH(2:1). The whole frame excluding the first
address byte is stored in RFIFO (RFIFO2, RFIFO3).
12.1.3
Transparent Mode 0
(MODE.MDS(2:0) = 100
B; MODE2.MDS2(2:0) = 100B; MODE3.MDS3(2:0) = 100B)
Characteristics: flag- and CRC generation/check, bit stuffing
No address recognition is performed and each frame is stored in the RFIFO (RFIFO2, RFIFO3).
12.1.4
SS7 Support
SS7 protocol is supported for channel 1 only by means of several hardware features.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PES12-42S-N0024 | |
| PESD3V3V4UK,132 | 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE |
| PF38F3050L0YUQ3A | SPECIALTY MEMORY CIRCUIT, PBGA88 |
| PFC04108.2UHKT | 1 ELEMENT, 8.2 uH, GENERAL PURPOSE INDUCTOR |
| PFC04101.8UHKT | 1 ELEMENT, 1.8 uH, GENERAL PURPOSE INDUCTOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PEF22554HT V2.1 | 制造商:Infineon Technologies AG 功能描述: |
| PEF22554HTV2.1 | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| PEF22554H-TV2.1 | 制造商:Infineon Technologies AG 功能描述: |
| PEF22554HT-V2.1 | 制造商:Infineon Technologies AG 功能描述:PEF22554HT-V2.1 |
| PEF22554HTV3.1 | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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