參數(shù)資料
型號： SPC563M64L5COAY
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 80 MHz, MICROCONTROLLER, PQFP144
封裝： 20 X 20 MM, LEAD FREE, LQFP-144
文件頁數(shù)： 12/140頁
文件大?。?/td> 1310K
代理商： SPC563M64L5COAY
Electrical characteristics
SPC563M64
109/140
Doc ID 14642 Rev 6
3.16.3
Calibration bus interface timing
Table 37.
Calibration bus operation timing (1)
1.
Calibration bus timing specified at fSYS = 80 MHz, VDD = 1.14 V to 1.32 V, VDDE = 1.62 V to 3.6 V (unless stated
otherwise), TA = TL to TH, and CL = 30 pF with DSC = 0b10.
#
Symbol
C
Characteristic
66 MHz (ext. bus)(2)
2.
The external bus is limited to half the speed of the internal bus. The maximum external bus frequency is 66 MHz.
Unit
Notes
Min
Max
1TC
CC
P
CLKOUT Period
15.2
—
ns
Signals are
measured at 50%
VDDE.
2tCDC
CC
D
CLKOUT duty cycle
45%
55%
TC
3tCRT
CC
D
CLKOUT rise time
—
(3)
3.
Refer to Fast Pad timing in Table 33 and Table 34 (different values for 3.3 V vs. 1.8 V).
ns
4tCFT
CC
D
CLKOUT fall time
—
ns
5tCOH
CC
P
CLKOUT Posedge to Output Signal
Invalid or High Z(Hold Time)
ADDR[8:31]
CS[0:3]
DATA[0:31]
OE
RD_WR
TS
WE[0:3]/BE[0:3]
1.0(4)/1.5
—
ns
Hold time
selectable via
SIU_ECCR[EBTS]
bit:
EBTS=0: 1.0ns
EBTS=1: 1.5ns
6tCOV
CC
P
CLKOUT Posedge to Output Signal Valid
(Output Delay)
ADDR[8:31]
CS[0:3]
DATA[0:31]
OE
RD_WR
TS
WE[0:3]/BE[0:3]
—6.0(4)/7.0
ns
Output valid time
selectable via
SIU_ECCR[EBTS]
bit:
EBTS=0: 5.5ns
EBTS=1: 6.5ns
7tCIS
CC
P
Input Signal Valid to CLKOUT Posedge
(Setup Time)
DATA[0:31]
5.0
—
ns
8tCIH
CC
P
CLKOUT Posedge to Input Signal Invalid
(Hold Time)
DATA[0:31]
1.0
—
ns
9tAPW
CC
P
ALE Pulse Width(5)
6.5
—
ns
10
tAAI
CC
P
ALE Negated to Address Invalid(5)
3—
ns
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