參數(shù)資料
型號(hào)： SPC563M64L5COAY
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 80 MHz, MICROCONTROLLER, PQFP144
封裝： 20 X 20 MM, LEAD FREE, LQFP-144
文件頁(yè)數(shù)： 133/140頁(yè)
文件大?。?/td> 1310K
代理商： SPC563M64L5COAY
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SPC563M64
Electrical characteristics
Doc ID 14642 Rev 6
3.9.2
LVDS pad specifications
LVDS pads are implemented to support the MSC (Microsecond Channel) protocol which is
an enhanced feature of the DSPI module. The LVDS pads are compliant with LVDS
specifications and support data rates up to 50 MHz.
Table 24.
VRC33 pad average DC current(1)
1.
These are typical values that are estimated from simulation and not tested. Currents apply to output pins only.
Pad
Type
Symbol
C
Period
(ns)
Load(2)
(pF)
2.
All loads are lumped.
VRC33
(V)
VDDE
(V)
Drive
Select
IDD33 Avg
(A)
IDD33 RMS
(A)
Fast
IDRV_FC
CC
D
10
50
3.6
11
3.32
11.77
CC
D
10
30
3.6
10
2.28
7.07
CC
D
10
20
3.6
01
1.73
5.75
CC
D
10
3.6
00
1.39
4.77
CC
D
10
50
3.6
1.98
11
2.3
7.81
CC
D
10
30
3.6
1.98
10
1.64
4.96
CC
D
10
20
3.6
1.98
01
1.37
4.31
CC
D
10
3.6
1.98
00
1.06
4.09
Table 25.
DSPI LVDS pad specification (1)
#
Characteristic
Symbol
C
Condition
Min.
Value
Typ.
Value
Max.
Value
Unit
Data Rate
4
Data Frequency
FLVDSCLK
CC
D
50
MHz
Driver Specs
5
Differential output voltage
VOD
CC
D
SRC=0b00 or
0b11
150
400
mV
CC
D
SRC=0b01
90
320
CC
D
SRC=0b10
160
480
6
Common mode voltage
(LVDS), VOS
VOS
CC
D
0.9
1.2
1.6
V
7
Rise/Fall time
TR/TF
CC
D
2
ns
8
Propagation delay (Low to
High)
TPLH
CC
D
4
ns
9
Propagation delay (High to
Low)
TPHL
CC
D
4
ns
10
Delay (H/L), sync Mode
tPDSYNC
CC
D
4
ns
11
Delay, Z to Normal (High/Low) TDZ
CC
D
500
ns
12
Diff Skew Itphla-tplhbI or
Itplhb-tphlaI
TSKEW
CC
D
0.5
ns
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