參數(shù)資料
型號： XRT74L74
廠商： Exar Corporation
英文描述： 4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
中文描述： 4通道，自動取款機(jī)統(tǒng)一/平價DS3/E3，界定控制器
文件頁數(shù)： 114/498頁
文件大?。?/td> 2941K
代理商： XRT74L74
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XRT74L74
4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
REV. P1.1.1
PRELIMINARY
112
1. The Transmit UTOPIA Data bus is configured to be
16 bits wide. Hence, the data which the ATM Layer
processor places on the Transmit UTOPIA Data
bus, is expressed in terms of 16-bit words (e.g.,
W0–W26).
2. The Transmit UTOPIA Interface Block is configured
to handle 54 bytes/cell. Hence, Figure 14 illus-
trates the ATM Layer processor writing 27 words
(e.g., W0 through W26) for each ATM cell.
In Figure 14 , the ATM Layer processor is initially writ-
ing ATM cell data to the Transmit UTOPIA Interface
block within UNI #2 (TxUAddr[4:0] = 02h). However,
the ATM Layer processor is also polling the Transmit
UTOPIA Interface block within UNI #1 (TxUAddr[4:0]
= 00h) and some “non-existent” device at TxU-
Addr[4:0] = 1Fh. The ATM Layer processor completes
its writing of the cell to UNI #1 at clock edge #4. After-
wards, the ATM Layer processor will cease to write
any more cell data to UNI #1, and will begin to write
this data into UNI #2 (TxUAddr[4:0] = 02h). The ATM
Layer processor will indicate its intentions to select a
new UNI device for writing by negating the TxUEn
signal, at clock edge #5 (see the shaded portion of
Figure 14 ). At this time, UNI #1 will notice two things:
1.
The UTOPIA Address for the Transmit UTOPIA
Interface block, within UNI #1 is on the Transmit
UTOPIA Address bus (TxUAddr[4:0] = 00h).
The TxUEn signal has been negated.
2.
UNI #1 will interpret this signaling as an indication
that the ATM Layer processor is going to be perform-
ing write operations to it. Afterwards, the ATM Layer
processor will begin to write ATM cell data into Trans-
mit UTOPIA Interface block, within UNI #1.
3.1.2.5
The Transmit UTOPIA Interface block will generate in-
terrupts upon the following conditions:
Detection of parity errors
Change of cell alignment (e.g., the detection of
“runt” cells)
TxFIFO Overrun
Transmit UTOPIA Interrupt Servicing
If one of these conditions occur and if that particular
condition is enabled for interrupt generation, then
when the local μP/μC reads the UNI Interrupt status
register, as shown below; it should read “xxxx1xxxb”
(where the b suffix denotes a binary expression, and
the “x” denotes a “don’t care” value).
At this point, the local μC/μP has determined that the
Transmit UTOPIA Interface block is the source of the
interrupt, and that the Interrupt Service Routine
should branch accordingly.
The next step in the interrupt service routine should
be to determine which of the three Transmit UTOPIA
Interface Block interrupt conditions has occurred and
is causing the Interrupt request. In order to accomplish
this, the local μP/μC should now read the TxUT Inter-
rupt Enable/Status Register, which is located at ad-
dress 6Eh within the UNI device. The bit format of this
register is presented below.
The “TxUT Interrupt Enable/Status” Register has
eight bit-fields. However, only six of these bit fields
are relevant to interrupt processing. Bits 0–2 are the
interrupt status bits and bits 3–5 are the interrupt en-
UNI Interrupt Status Register (Address = 05h)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Rx DS3
Interrupt
Status
Rx PLCP
Interrupt
Status
Rx CP
Interrupt
Status
Rx UTOPIA
Interrupt
Status
TxUTOPIA
Interrupt
Status
TxCP
Interrupt
Status
TxDS3 Inter-
rupt
Status
One Sec
Interrupt
Status
RO
RO
RO
RO
RO
RO
RO
RUR
x
x
x
x
1
x
x
x
TxUT Interrupt Enable /Status Register (Address-6Eh)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
TFIFO
Reset
Discard
Upon
PErr
TPerr
Interrupt
Enable
TxFIFO
ErrInt
Enable
TCOCA
Interrupt
Enable
TPErr
Interrupt
Status
TxFIFO
OverInt
Status
TCOCA
Interrupt
Status
R/W
R/W
R/W
R/W
R/W
RUR
RUR
RUR
相關(guān)PDF資料
PDF描述
XRT74L74IB 4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT75L00D E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L00DIV E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L02 TWO CHANNEL E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER
XRT75L02IV TWO CHANNEL E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER
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參數(shù)描述
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XRT75L00 制造商:EXAR 制造商全稱:EXAR 功能描述:E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER ATTENUATOR
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XRT75L00DIV 功能描述:外圍驅(qū)動器與原件 - PCI 3.3V 1 CH E3/DS3/STS W/SONET DE-SYNCH RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray
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