參數(shù)資料
型號： XRT74L74
廠商： Exar Corporation
英文描述： 4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
中文描述： 4通道，自動取款機統(tǒng)一/平價DS3/E3，界定控制器
文件頁數(shù)： 188/498頁
文件大小： 2941K
代理商： XRT74L74
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XRT74L74
4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
REV. P1.1.1
PRELIMINARY
186
Note: regarding Figure 46
1. The Receive UTOPIA Data bus is configured to be
16 bits wide. Hence, the data, which the Receive
UTOPIA Interface block places on the Receive
UTOPIA Data bus, is expressed in terms of 16-bit
words (e.g., W0–W26).
2. The Receive UTOPIA Interface Block is configured
to handle 54 bytes/cell. Hence, Figure 46 illus-
trates the ATM Layer processor reading 27 words
(e.g., W0 through W26) for each ATM cell.
In Figure 46 , the ATM Layer processor is initially
reading ATM cell data from the Receive UTOPIA
Interface within UNI #2 (RxUAddr[4:0] = 03h). How-
ever, the ATM Layer processor is also polling the
Receive UTOPIA Interface block within UNI #1 (RxU-
Addr[4:0] = 01h) and some “non-existent” device at
RxUAddr[4:0] = 1Fh. The ATM Layer processor com-
pletes its reading of the cell from UNI #1 at clock
edge #4. Afterwards, the ATM Layer will cease to
read any more cell data from UNI #1, and will begin to
read some cell data from UNI #2 (RxUAddr[4:0] =
03h). The ATM Layer processor will indicates its
intention to select a new UNI device for reading by
negating the RxUEn signal, at clock edge #5 (see the
shaded portion of Figure 46 ). At this time, UNI #1 will
notice two things:
1.
The UTOPIA Address for the Receive UTOPIA
Interface block, within UNI #1 is on the Receive
UTOPIA Address bus (RxUAddr[4:0] = 01h).
The RxUEn signal has been negated.
2.
UNI #1 will interpret this signaling as an indication
that the ATM Layer processor is going to be perform-
ing read operations from it. Afterwards, the ATM
Layer processor will begin to read ATM cell data from
the Receive UTOPIA Interface block, within UNI #1.
4.4.2.3
The Receive UTOPIA Interface block will generate
interrupts upon the following conditions:
Change of Cell Alignment (e.g., the detection of
“runt” cells)
RxFIFO Overrun
RxFIFO Underrun
Receive UTOPIA Interrupt Servicing
If one of these conditions occur and if that particular
condition is enabled for interrupt generation, then
when the local μP/μC reads the UNI Interrupt status
register, as shown below, it should read “xxx1xxxxb”
(where the -b suffix denotes a binary expression, and
the -x denotes a “don’t care” value).
At this point, the local μC/μP has determined that the
Receive UTOPIA Interface block is the source of the
interrupt, and that the Interrupt Service Routine
should branch accordingly.
The next step in the interrupt service routine should be
to determine which of the three Receive UTOPIA Block
interrupt conditions has occurred and is causing the
Interrupt. In order to accomplish this, the local μP/μC
should now read the “RxUT Interrupt Enable/Status
Register, which is located at address 6Bh in the UNI
device. The bit format of this register is presented be-
low.
UNI Interrupt Status Register (Address = 05h)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
RxDS3
Interrupt
Status
RxPLCP
Interrupt
Status
RxCP
Interrupt
Status
RxUTOPIA
Interrupt
Status
TxUTOPIA
Interrupt
Status
TxCP
Interrupt
Status
TxDS3
Interrupt
Status
One Sec
Interrupt
Status
RO
RO
RO
RO
RO
RO
RO
RUR
x
x
x
x
1
x
x
x
Address = 6Bh, RxUT Interrupt Enable/Status Register
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Unused
RxFIFO
Reset
RxFIFO
Overflw
Interrupt
Enable
RxFIFO
Underflw
Interrupt
Enable
RCOCA
Interrupt
Enable
RxFIFO
Overflw
Interrupt
Status
RxFIFO
Underflw
Interrupt
Status
RCOCA
Interrupt
Status
RO
R/W
R/W
R/W
R/W
RUR
RUR
RUR
相關(guān)PDF資料
PDF描述
XRT74L74IB 4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT75L00D E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L00DIV E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L02 TWO CHANNEL E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER
XRT75L02IV TWO CHANNEL E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER
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參數(shù)描述
XRT74L74IB 制造商:EXAR 制造商全稱:EXAR 功能描述:4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT75L00 制造商:EXAR 制造商全稱:EXAR 功能描述:E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER ATTENUATOR
XRT75L00D 制造商:EXAR 制造商全稱:EXAR 功能描述:E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L00DES 功能描述:時鐘合成器/抖動清除器 LIU+DESYNCH 3.3V LIU+DESYNCH 3.3V RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
XRT75L00DIV 功能描述:外圍驅(qū)動器與原件 - PCI 3.3V 1 CH E3/DS3/STS W/SONET DE-SYNCH RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray
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