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參數(shù)資料
| 型號： | XRT86VL3x |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 19/153頁 |
| 文件大?。?/td> | 1316K |
| 代理商： | XRT86VL3X |
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XRT86VL3X
12
REV. 1.2.2
T1/E1/J1 FRAMER/LIU COMBO - ARCHITECTURE DESCRIPTION
1.10
Overhead Interface
The Overhead interface provides an option for inserting the datalink bits into the transmit PCM data or
extracting the datalink bits from the receive PCM data. By default, the datalink information is processed to and
from the PCM data directly. On the transmit path, the overhead clock is automatically provided as a clock
reference to externally time the datalink bits. The user should provide data on the rising edge of the TxOHclk
so that the framer can sample the datalink bits on the falling edge. On the receive path, the datalink bits are
updated on the rising edge of the RxOHclk output pin. In T1 ESF mode, a datalink bit occurs every other
frame. Therefore, the default overhead interface is operating at 4kbps. In E1 mode, the datalink bits are
located in the first time slot of each Non-FAS frame.
Figure 14
is a simplified block diagram of the Overhead
Interface.
Figure 15
is a simplified diagram for the T1 external overhead datalink bus.
Figure 16
is a
simplified diagram for the E1 external overhead datalink bus.
F
IGURE
13. SF / SLC-96
OR
4-
CODE
S
IGNALING
IN
ESF / CAS E
XTERNAL
S
IGNALING
B
US
F
IGURE
14. T1/E1 O
VERHEAD
I
NTERFACE
TxSYNC
TxMSYNC
TxSERclk
TxCHN0/TxSIG
TxSER
F
B
A
TS 1
B
A
B
A
TS 2
TS 3
Datalink Bits
PCM Data
Tx LIU
Rx LIU
Datalink Bits
PCM Data
Transmit Direction
Receive Direction
TxSER
TxOH
TxOHclk
RxSER
RxOH
RxOHclk
Physical
Interface
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PDF描述 |
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