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參數資料
| 型號： | XRT86VL3x |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網絡 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數： | 46/153頁 |
| 文件大小： | 1316K |
| 代理商： | XRT86VL3X |
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XRT86VL3X
39
T1/E1/J1 FRAMER/LIU COMBO - ARCHITECTURE DESCRIPTION
REV. 1.2.2
4.2.3
Configure the DS1 Receive Overhead Output Interface module as destination of the
Signaling Framing (Fs) bits in N or SLC96 framing format mode
The Fs bits in SLC96 and N framing format mode can be extracted to:
DS1 Receive Overhead Output Interface Block
DS1 Receive HDLC Controller
DS1 Receive Serial Output Interface.
The Receive Data Link Source Select bits of the Receive Data Link Select Register (RDLSR) controls the
destination of Fs bits in N or SLC96 framing format mode. The table below shows configuration of the
Receive Data Link Source Select bits of the Receive Data Link Select Register (RDLSR).
If the Receive Data Link Source Select bits of the Receive Data Link Select Register are set to 10, the Receive
Overhead Output Interface Block outputs Fs bits extracted from the incoming T1 data stream.
F
IGURE
39. DS1 R
ECEIVE
O
VERHEAD
O
UTPUT
I
NTERFACE
MODULE
IN
ESF
FRAMING
FORMAT
MODE
RECEIVE DATA LINK SELECT REGISTER (TDLSR) (ADDRESS = 0XN10AH)
B
IT
N
UMBER
B
IT
N
AME
B
IT
T
YPE
B
IT
D
ESCRIPTION
1-0
Receive Data Link
Source Select
R/W
00 - The extracted Facility Data Link bits are stored in either the LAPD con-
troller or the SLC96 buffer. At the same time, the extracted Facility Data
Link bits are outputted from the framer through the Receive Serial Data
Output Interface via the RxSer_n pins.
01 - The extracted Facility Data Link bits are outputted from the framer
through the Receive Serial Data Output Interface via the RxSer_n pins.
10 - The extracted Facility Data Link bits are outputted from the framer
through the Receive Overhead Output Interface via the RxOH_n pins. At
the same time, the extracted Facility Data Link bits are outputted from the
framer through the Receive Serial Data Output Interface via the RxSer_n
pins.
11 - The Facility Data Link bits are forced to one by the framer.
RxOhClk
(2KHz,even)
RxOh
(2KHz,even)
RxOh
(4KHz)
RxOhClk
(2KHz,odd)
RxOh
(2KHz,odd)
Frame #
RxSync
RxOhClk
(4KHz)
1
2
6
3
4
5
7
8
9
10
11
12
13
14
15
16
17
18
19
20
相關PDF資料 |
PDF描述 |
|---|---|
| XRT86VL3X_07 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL3X | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT91L30_0611 | STS-12/STM-4 OR STS-3/STM-1 SONET/SDH TRANSCEIVER |
| XRT91L306 | STS-12/STM-4 OR STS-3/STM-1 SONET/SDH TRANSCEIVER |
| XRT91L30IQ | STS-12/STM-4 OR STS-3/STM-1 SONET/SDH TRANSCEIVER |
相關代理商/技術參數 |
參數描述 |
|---|---|
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