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參數(shù)資料
| 型號： | XRT86VL3x |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 27/153頁 |
| 文件大小： | 1316K |
| 代理商： | XRT86VL3X |
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XRT86VL3X
20
REV. 1.2.2
T1/E1/J1 FRAMER/LIU COMBO - ARCHITECTURE DESCRIPTION
3.0
HDLC CONTROLLERS AND LAPD MESSAGES
The purpose of the HDLC controllers is to allow messages to be stored for transport in the outbound transmit
framer block or extracted from the receive framer block through the LAPD interface. Each channel within the
Framer has 3 independent HDLC controllers. Each HDLC controller has two 96-Byte buffers for Transmit and
two 96-Byte buffers for Receive. The buffers are used to insert messages into the out going data stream for
Transmit or to extract messages from the incoming data stream from the Receive path. Total, there are twelve
96-Byte buffers per channel. This allows multiple HDLC messages to be transported to and from EXAR’s
framing device.
F
IGURE
28. HDLC C
ONTROLLERS
Buffer 0
Buffer 1
Transmit
Receive
96-Bytes
96-Bytes
96-Bytes
96-Bytes
Transmit
Receive
96-Bytes
96-Bytes
96-Bytes
96-Bytes
Transmit
Receive
96-Bytes
96-Bytes
96-Bytes
96-Bytes
HDLC1
HDLC2
HDLC3
Buffer 0
Buffer 1
Buffer 0
Buffer 1
Channel N
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT86VL3X_07 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL3X | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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| XRT91L306 | STS-12/STM-4 OR STS-3/STM-1 SONET/SDH TRANSCEIVER |
| XRT91L30IQ | STS-12/STM-4 OR STS-3/STM-1 SONET/SDH TRANSCEIVER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XRT86VX38_0906 | 制造商:EXAR 制造商全稱:EXAR 功能描述:OCTAL T1/E1/J1 FRAMER/LIU COMBO - HARDWARE DESCRIPTION |
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