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參數(shù)資料
| 型號： | XRT86VL3x |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 73/153頁 |
| 文件大?。?/td> | 1316K |
| 代理商： | XRT86VL3X |
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XRT86VL3X
66
REV. 1.2.2
T1/E1/J1 FRAMER/LIU COMBO - ARCHITECTURE DESCRIPTION
can position the beginning of the multiplexed E1 frame. It is responsibility of the Terminal Equipment to align
the multiplexed transmit serial data with the Transmit Single-frame Synchronization pulse.
Inside the framer, all the "don't care" bits will be stripped away. The framing bits, signaling and payload data are
de-multiplexed inside the XRT86VL3x device and send to each individual channel. These data will be
processed by each individual framer and send to LIU interface. The local Terminal Equipment provides a free-
running 2.048MHz clock to the Transmit Serial Input clock of each channel. The framer will use this clock to
carry the processed payload and signaling data to the transmit section of the device.
See Figure 69 below for how to interface the local Terminal Equipment with the Transmit Payload Data Input
Interface block of the framer in HMVIP or H100 16.384Mbit/s mode. Figure 71 shows the timing signals when
the framer is running at HMVIP or H100 16.384 MHz mode.
F
IGURE
69. I
NTERFACING
XRT86VL3
X
T
RANSMIT
TO
LOCAL
TERMINAL
EQUIPMENT
USING
16.384M
BIT
/
S
, HMVIP
16.384M
BIT
/
S
,
AND
H.100 16.384M
BIT
/
S
F
IGURE
70. T
IMING
SIGNAL
WHEN
THE
FRAMER
IS
RUNNING
AT
B
IT
-M
ULTIPLEXED
16.384M
BIT
/
S
MODE
TxSER0
TxINCLK0 (16.384MHz)
TxSYNC0
TxSERCLK0 (2.048MHz)
Transmit
Payload
Data Input
Interface
Chn 0
Transmit
Payload
Data Input
Interface
Chn 4
Terminal
Equipment
XRT86VL38
Chn 1
Chn 2
Chn 3
Chn 5
Chn 6
Chn 7
TxSERCLK1 (2.048MHz)
TxSERCLK2 (2.048MHz)
TxSERCLK3 (2.048MHz)
TxSER4
TxINCLK4 (16.384MHz)
TxSYNC4
TxSERCLK4 (2.048MHz)
TxSERCLK5 (2.048MHz)
TxSERCLK6 (2.048MHz)
TxSERCLK7 (2.048MHz)
TxInClk (16.384MHz)
TxInClk (INV)
TxSer
TxSync(input)
1
0
X 1
1
X
X
X
1
2
1
3
2
0
X 2
1
X
X
3
0
4
0
X
5
0
A
0
5
1
A
1
5
2
A
2
5
3
A
3
56 cycles
h
0
X h
1
X
X
X
h
2
h
3
8-bit header
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT86VL3X_07 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL3X | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT91L30_0611 | STS-12/STM-4 OR STS-3/STM-1 SONET/SDH TRANSCEIVER |
| XRT91L306 | STS-12/STM-4 OR STS-3/STM-1 SONET/SDH TRANSCEIVER |
| XRT91L30IQ | STS-12/STM-4 OR STS-3/STM-1 SONET/SDH TRANSCEIVER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT86VL3X_07 | 制造商:EXAR 制造商全稱:EXAR 功能描述:T1/E1/J1 FRAMER/LIU COMBO - ARCHITECTURE DESCRIPTION |
| XRT86VL3X_0710 | 制造商:EXAR 制造商全稱:EXAR 功能描述:T1/E1/J1 FRAMER/LIU COMBO - ARCHITECTURE DESCRIPTION |
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| XRT86VX38_09 | 制造商:EXAR 制造商全稱:EXAR 功能描述:8-CHANNEL T1/E1/J1 FRAMER/LIU COMBO - T1 REGISTER DESCRIPTION |
| XRT86VX38_0906 | 制造商:EXAR 制造商全稱:EXAR 功能描述:OCTAL T1/E1/J1 FRAMER/LIU COMBO - HARDWARE DESCRIPTION |
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