參數(shù)資料
型號(hào)： 30046-23
廠商： NATIONAL SEMICONDUCTOR CORP
元件分類： 微控制器/微處理器
英文描述： Low Power Integrated x86-Compatible 32-Bit Geode GXLV Processor(低功耗集成兼容X86的32位 Geode GXLV技術(shù)處理器)
中文描述： 32-BIT, 200 MHz, MICROPROCESSOR, CPGA320
封裝： SPGA-320
文件頁(yè)數(shù)： 198/247頁(yè)
文件大?。?/td> 4379K
代理商： 30046-23
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www.national.com
198
Revision 1.2
Electrical Specifications (
Continued
)
G
t12
SDCLK_OUT, SDCLK[3:0] Fall Time
166 MHz / 2.5
0.5
ns
Note 3
180 MHz / 2.5
0.5
180 MHz / 3
0.5
200 MHz / 3
0.5
233 MHz / 3
0.5
233 MHz / 3.5
0.5
266 MHz / 3.5
0.5
266 MHz / 4
0.5
t13
SDCLK_OUT, SDCLK[3:0] Rise Time
166 MHz
0.45
ns
Note 3
180 MHz
0.45
180 MHz
200 MHz
0.45
233 MHz
0.45
233 MHz
266 MHz
0.45
266 MHz
Notes:
1. A SYSCLK of 30 MHz corresponds to a core frequency of 180 MHz. A SYSCLK of 33 MHz corresponds to
core frequencies of 166, 200, 233, and 266 MHz.
2.
SDCLK calculations are based on the following officially supported configurations:
166 MHz (5x) / 2.5 = 66.4 MHz SDCLK_OUT
180 MHz (5x) / 2.5 = 72 MHz SDCLK_OUT
180 MHz (6x) / 3 = 60 MHz SDCLK_OUT
200 MHz (6x) / 3 = 66.7 MHz SDCLK_OUT
233 MHz (7x) / 3 = 77.7 MHz SDCLK_OUT
233 MHz (7x) / 3.5 = 66.6 MHz SDCLK_OUT
266 MHz (8x) / 3.5 = 76 MHz SDCLK_OUT
266 MHz (8x) / 4 = 66.5 MHz SDCLK_OUT
3. SDCLK_OUT and SYSCLK rise and fall times are measured between V
IH
min and V
IL
max with a 50 pF
load.
Table 6-14. Clock Signals (Refer to Figures 6-5 and 6-6) (Continued)
Symbol
Parameter
SYSCLK = 33 MHz
SYSCLK = 30 MHz
Units
Comments
Min
Typ
Max
Min
Typ
Max
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PDF描述
300471U Radial, -55dotc, long life wsitching-power
300CNQ SCHOTTKY RECTIFIER
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300-466B 制造商:LG Corporation 功能描述:CABINET ASSYCMT-9324
300-466K 制造商:LG Corporation 功能描述:CABINET ASSYCMT-9322
300-466R 制造商:LG Corporation 功能描述:FRONT CABINET
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