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參數(shù)資料
| 型號： | 30046-23 |
| 廠商： | NATIONAL SEMICONDUCTOR CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Low Power Integrated x86-Compatible 32-Bit Geode GXLV Processor(低功耗集成兼容X86的32位 Geode GXLV技術(shù)處理器) |
| 中文描述： | 32-BIT, 200 MHz, MICROPROCESSOR, CPGA320 |
| 封裝： | SPGA-320 |
| 文件頁數(shù)： | 238/247頁 |
| 文件大?。?/td> | 4379K |
| 代理商： | 30046-23 |
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www.national.com
238
Revision 1.2
Instruction Set (
Continued
)
G
7.6
National Semiconductor has added instructions to its
implementation of the Intel MMX architecture in order to
facilitate writing of multimedia applications. In general,
these instructions allow more efficient implementation of
multimedia algorithms, or more precision in computation
than can be achieved using the basic set of MMX instruc-
tions. All of the added instructions follow the SIMD (single
instruction, multiple data) format. Many of the instructions
add flexibility to the MMX architecture by allowing both
source operands of an instruction to be preserved, while
the result goes to a separate register that is derived from
the input.
EXTENDED MMX INSTRUCTION SET
Table 7-33 summarizes the Extended MMX Instructions.
The abbreviations used in the table are listed in Table 7-
32.
Configuration control register CCR7(0) at Index EBh (see
Table 3-11 on page 53) must be set to allow the execution
of the Extended MMX instructions.
Table 7-32. Extend MMX Instruction Set
Table Legend
Abbreviation
Description
<----
Result written.
[11 mm reg]
Binary or binary groups of digits.
mm
One of eight 64-bit MMX registers.
reg
A general purpose register.
<--sat--
If required, the resultant data is saturated
to remain in the associated data range.
<--move--
Source data is moved to result location.
[byte]
Eight 8-bit BYTEs are processed in paral-
lel.
[word]
Four 16-bit WORDs are processed in par-
allel.
[dword]
Two 32-bit DWORDs are processed in par-
allel.
[qword]
One 64-bit QWORD is processed.
[sign xxx]
The BYTE, WORD, DWORD or QWORD
most significant bit is a sign bit.
mm1, mm2
MMX Register 1, MMX Register 2.
mod r/m
Mod and r/m byte encoding (Table 7-15 on
page 211).
pack
Source data is truncated or saturated to
next smaller data size, then concatenated.
packdw
Pack two DWORDs from source and two
DWORDs from destination into QWORDs
in destination register.
packwb
Pack QWORDs from source and QWORDs
from destination into eight BYTEs in desti-
nation register.
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