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參數(shù)資料
| 型號： | A3P1000-1PQG208PQ208 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 1000000 GATES, PQFP208 |
| 封裝： | 0.50 MM PITCH, GREEN, PLASTIC, QFP-208 |
| 文件頁數(shù)： | 129/608頁 |
| 文件大?。?/td> | 20486K |
| 代理商： | A3P1000-1PQG208PQ208 |
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Core Architecture of IGLOO and ProASIC3 Devices
1- 6
v1.1
Array Coordinates
During many place-and-route operations in the Actel Designer software tool, it is possible to set
constraints that require array coordinates. Table 1-2 provides array coordinates of core cells and
memory blocks for ProASIC3 and IGLOO devices. Table 1-3 provides the information for IGLOO
PLUS devices. The array coordinates are measured from the lower left (0, 0) They can be used in
region constraints for specific logic groups/blocks, designated by a wildcard, and can contain core
cells, memories, and I/Os.
I/O and cell coordinates are used for placement constraints. Two coordinate systems are needed
because there is not a one-to-one correspondence between I/O cells and core cells. In addition, the
I/O coordinate system changes depending on the die/package combination. It is not listed in
Table 1-2. The Designer ChipPlanner tool provides the array coordinates of all I/O locations. I/O and
cell coordinates are used for placement constraints. However, I/O placement is easier by package
pin assignment.
Figure 1-6 on page 1-7 illustrates the array coordinates of a 600 k gate device. For more
information on how to use array coordinates for region/placement constraints, see the Designer
Table 1-2
IGLOO and ProASIC3 Array Coordinates
Device
VersaTiles
Memory Rows
Entire Die
Min.
Max.
Bottom
Top
Min.
Max.
ProASIC3/
ProASIC3L
IGLOO
x
y
x
y
(x, y)
A3P015
AGL015
3
2
34
13
None
(0, 0)
(37, 15)
A3P030
AGL030
3
66
13
None
(0, 0)
(69, 15)
A3P060
AGL060
3
2
66
25
None
(3, 26)
(0, 0)
(69, 29)
A3P125
AGL125
3
2
130
25
None
(3, 26)
(0, 0)
(133, 29)
A3P250/L
AGL250
3
2
130
49
None
(3, 50)
(0, 0)
(133, 53)
A3P400
3
2
194
49
None
(3, 50)
(0, 0)
(197, 53)
A3P600/L
AGL600
3
4
194
75
(3, 2)
(3, 76)
(0, 0)
(197, 79)
A3P1000/L
AGL1000
3
4
258
99
(3, 2)
(3, 100)
(0, 0)
(261, 103)
A3PE600
AGLE600
3
4
194
75
(3, 2)
(3, 76)
(0, 0)
(197, 79)
A3PE1500
3
4
322
123
(3, 2)
(3, 124)
(0, 0)
(325, 127)
A3PE3000/L
AGLE3000
3
6
450
173
(3, 2)
or
(3, 4)
(3, 174)
or
(3, 176)
(0, 0)
(453, 179)
Table 1-3
IGLOO PLUS Array Coordinates
Device
VersaTiles
Memory Rows
Entire Die
Min.
Max.
Bottom
Top
Min.
Max.
IGLOO PLUS
x
y
x
y
(x, y)
AGLP030
2
3
67
13
None
(0, 0)
(69, 15)
AGLP060
2
67
25
None
(3, 26)
(0, 0)
(69, 29)
AGLP125
2
131
25
None
(3, 26)
(0, 0)
(133, 29)
相關PDF資料 |
PDF描述 |
|---|---|
| A3P1000-2FG144FG144 | FPGA, 1000000 GATES, PBGA144 |
| A3P1000-2FG144IFG144 | FPGA, 1000000 GATES, PBGA144 |
| A3P1000-2FG256FG256 | FPGA, 1000000 GATES, PBGA256 |
| A3P1000-2FG256IFG256 | FPGA, 1000000 GATES, PBGA256 |
| A3P1000-2FG484FG484 | FPGA, 1000000 GATES, PBGA484 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| A3P1000-1VQ144 | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| A3P1000-1VQ144ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| A3P1000-1VQ144I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| A3P1000-1VQ144PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| A3P1000-1VQ144T | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Automotive ProASIC3 Flash Family FPGAs |
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