參數(shù)資料
型號(hào)： A3P1000-1PQG208PQ208
元件分類(lèi)： FPGA
英文描述： FPGA, 1000000 GATES, PQFP208
封裝： 0.50 MM PITCH, GREEN, PLASTIC, QFP-208
文件頁(yè)數(shù)： 565/608頁(yè)
文件大?。?/td> 20486K
代理商： A3P1000-1PQG208PQ208
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Metastability Characterization Report for Actel Flash FPGAs
v1.0
22- 5
The metastability theory indicates that C1 and C2 are independent of the test clock and data
frequency. The test results concur within experimental tolerances. The calculations of C1 and C2 are
given in Table 22-1.
Examples of Metastability Coefficients Usage
Metastability shows a statistical nature, and designers should allow enough additional time (Tmet)
that the likelihood of metastable failure is remote enough to be tolerable by the design
specification.
For example, consider that the simple circuit in Figure 22-1 on page 22-2 is implemented in a
ProASICPLUS device to synchronize an asynchronous data input to the FPGA. The following
parameters are given to designer by either design specification or post-layout timing analysis:
Tco = 10 ns, corresponding to a clock frequency of 100 MHz
Asynchronous data transition rate = 12.5 MHz
Tolerable MTBF = 1 year
If the designer does not allow additional sampling time (Tmet = 0 ns) and run the clock at the rate
of 100 MHz, EQ 22-12 on page 22-4 will result in MTBF = 51.2 s. This means that a metastability
error will occur at the output of the second flip-flop every 51.2 s. This value exceeds the required
MTBF of one year indicated in the design specification. To meet this requirement, the designer
needs to allow additional Tmet in the sampling time, which can be calculated as follows:
1 year = 365 × 24 × 3,600 = 31,536,000 seconds
ln 31,536,000 = 9.148E+09 × Tmet – ln (1.56E–11 × 100E6 × 12.5E6) ≥ Tmet = 2.96 ns
Therefore, an additional 3 ns sampling time will fulfill the required MTBF.
Part Number and Revision Date
This document was previously published as an application note describing features and functions
of the device, and as such has now been incorporated into the device handbook format. No
technical changes have been made to the content.
Part Number 51700094-023-0
Revised January 2008
List of Changes
The following table lists critical changes that were made in the current version of the chapter.
Table 22-1 Metastability Coefficients for Actel Flash FPGAs
fc = 10 MHz
Device Family
C1 (s)
C2 (s)
ProASIC
9.95E–11
1.03E+10
ProASICPLUS
1.56E–11
9.148E+09
ProASIC3/E Core Registers
9.11E–12
1.57E+10
ProASIC3/E I/O Registers
2.25E–12
1.91E+10
Previous Version
Changes in Current Version (v1.0)
Page
5190062-1/5.04
include ProASIC3/E information.
5190062-0
This document was updated to provide a detailed description of the
calculations being made.
相關(guān)PDF資料
PDF描述
A3P1000-2FG144FG144 FPGA, 1000000 GATES, PBGA144
A3P1000-2FG144IFG144 FPGA, 1000000 GATES, PBGA144
A3P1000-2FG256FG256 FPGA, 1000000 GATES, PBGA256
A3P1000-2FG256IFG256 FPGA, 1000000 GATES, PBGA256
A3P1000-2FG484FG484 FPGA, 1000000 GATES, PBGA484
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
A3P1000-1VQ144 制造商:ACTEL 制造商全稱(chēng):Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs
A3P1000-1VQ144ES 制造商:ACTEL 制造商全稱(chēng):Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs
A3P1000-1VQ144I 制造商:ACTEL 制造商全稱(chēng):Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs
A3P1000-1VQ144PP 制造商:ACTEL 制造商全稱(chēng):Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs
A3P1000-1VQ144T 制造商:ACTEL 制造商全稱(chēng):Actel Corporation 功能描述:Automotive ProASIC3 Flash Family FPGAs
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