參數(shù)資料
型號(hào): AM79C970A
廠商: Advanced Micro Devices, Inc.
英文描述: PCnet-PCI II Single-Chip Full-Duplex Ethernet Controller for PCI Local Bus Product
中文描述: PCnet - 2的PCI單芯片全雙工以太網(wǎng)控制器,適用于PCI總線產(chǎn)品
文件頁數(shù): 181/219頁
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代理商: AM79C970A
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P R E L I M I N A R Y
AMD
181
Am79C970A
SWITCHING CHARACTERISTICS: GPSI
Parameter
Symbol
Transmit Timing
t
GPT1
t
GPT2
t
GPT3
Parameter Name
Test Condition
Min
Max
Unit
TXCLK Period (802.3 Compliant)
TXCLK HIGH Time
TXDAT and TXEN Delay from
TXCLK
RXEN Setup Before
TXCLK (Last Bit)
RXEN Hold After
TXEN
CLSN Active Time to Trigger Collision
CLSN Active to
RXEN to
Prevent LCAR Assertion
CLSN Active to
RXEN for
SQE Heartbeat window
CLSN Active to
RXEN for
Normal Collision
@ 1.5 V
@ 2.0 V
@ 1.5 V
99.99
40
0
100.01
60
70
ns
ns
ns
t
GPT4
@ 1.5 V
210
ns
t
GPT5
t
GPT6
t
GPT7
@ 1.5 V
0
ns
ns
ns
@ 1.5 V (Note 1)
@ 1.5 V
110
0
t
GPT8
@ 1.5 V
0
4.0
μ
s
t
GPT9
@ 1.5 V
15
ns
Receive Timing
t
GPR1
t
GPR2
t
GPR3
t
GPR4
t
GPR5
t
GPR6
t
GPR7
RXCLK Period
RXCLK HIGH Time
RXCLK LOW Time
RXDAT and RXEN Setup to
RXCLK
RXDAT Hold after
RXCLK
RXEN Hold after
RXCLK
CLSN Active to First
RXCLK
(Collision Recognition)
CLSN Active to
RXCLK
for Address Type Designation Bit
CLSN Setup to Last
RXCLK for
Collision Recognition
CLSN Active
CLSN Inactive Setup to First
RXCLK
CLSN Inactive Hold to Last
RXCLK
@ 1.5 V (Note 2)
@ 2.0 V (Note 2)
@ 0.8 V (Note 2)
@ 1.5 V
@ 1.5 V
@ 1.5 V
@ 1.5 V
80
30
30
15
15
0
0
120
80
80
ns
ns
ns
ns
ns
ns
ns
t
GPR8
@ 1.5 V (Note 3)
51.2
μ
s
t
GPR9
@ 1.5 V
210
ns
t
GPR10
t
GPR11
t
GPR12
@ 1.5 V
@ 1.5 V
@ 1.5 V
110
300
300
ns
ns
ns
Notes:
1. CLSN must be asserted for a continuous period of 110 ns or more. Assertion for less than 110 ns period may or may not
result in CLSN recognition.
2. RXCLK should meet jitter requirements of IEEE 802.3 specification.
3. CLSN assertion before 51.2
μ
s will be indicated as a normal collision. CLSN assertion after 51.2
μ
s will be considered as a
Late Receive Collision.
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PDF描述
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