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660
SAM4CP [DATASHEET]
43051E–ATPL–08/14
33.8.1 SPI Control Register
Name:
SPI_CR
Address:
0x40008000 (0), 0x48000000 (1)
Access:
Write-only
SPIEN: SPI Enable
0 = No effect.
1 = Enables the SPI to transfer and receive data.
SPIDIS: SPI Disable
0 = No effect.
1 = Disables the SPI.
As soon as SPIDIS is set, SPI finishes its transfer.
All pins are set in input mode and no data is received or transmitted.
If a transfer is in progress, the transfer is finished before the SPI is disabled.
If both SPIEN and SPIDIS are equal to one when the control register is written, the SPI is disabled.
SWRST: SPI Software Reset
0 = No effect.
1 = Reset the SPI. A software-triggered hardware reset of the SPI interface is performed.
The SPI is in slave mode after software reset.
PDC channels are not affected by software reset.
LASTXFER: Last Transfer
0 = No effect.
1 = The current NPCS will be de-asserted after the character written in TD has been transferred. When CSAAT is set, the commu-
nication with the current serial peripheral can be closed by raising the corresponding NPCS line as soon as TD transfer is
completed.
Refer to
Section 33.7.3.5 ”Peripheral Selection”
for more details.
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1
0
SWRST
SPIDIS
SPIEN
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